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2017年3月28日
Tcl与Design Compiler (八)——DC的逻辑综合与优化
摘要: 本文如果有错,欢迎留言更正;此外,转载请标明出处 http://www.cnblogs.com/IClearner/ ,作者:IC_learner 对进行时序路径、工作环境、设计规则等进行约束完成之后,DC就可以进行综合、优化时序了,DC的优化步骤将在下面进行讲解。然而,当普通模式下不能进行优化的,
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posted @ 2017-03-28 18:12 IC_learner
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