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2014年7月22日 #

verilog中defparam的用法 (verilog调用底层模块(只改变)参数的传递)

摘要: 当一个模块引用另外一个模块时,高层模块可以改变低层模块用parameter定义的参数值,改变低层模块的参数值可采用以下两种方式: 1)defparam 重定义参数 语法:defparam path_name = value ; 低层模块的参数可以通过层次路径名重新定义,如下例:module t... 阅读全文

posted @ 2014-07-22 21:08 南开小巷 阅读(2631) 评论(0) 推荐(0) 编辑

转:滤波电容、去耦电容、旁路电容的作用

摘要: 滤波电容用在电源整流电路中,用来滤除交流成分。使输出的直流更平滑。 去耦电容用在放大电路中不需要交流的地方,用来消除自激,使放大器稳定工作。 旁路电容用在有电阻连接时,接在电阻两端使交流信号顺利通过。 1.关于去耦电容蓄能作用的理解 1)去耦电容主要是去除高频如RF信号的干扰,干... 阅读全文

posted @ 2014-07-22 21:02 南开小巷 阅读(758) 评论(0) 推荐(0) 编辑