Xilinx ISE的时序约束

    使用Synplify Pro加时序约束。综合完毕后，可以在ISE中进行布局、布线。需要用.ucf文件指定布局布线的时钟约束。前者可以比后者小。

早期的ISE，两个约束可以继承。现在用的高版本，反而需要分别指定，否则会忽略掉。