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2021年7月27日
基于FPGA的16位带级联信号数值比较器设计
摘要: 1.项目介绍 数值比较器就是对两数A、B进行比较,以判断其大小的逻辑电路。 2. 设计要求: (1)设计一个16位比较器,比较两个数a和b的大小,有三个输出端(大于、小于或等于)。当a大于b,则obig=1,其余为0;当a小于b,则osmall=1,其余为0;当a等于b时,则oequal=1,其余为
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posted @ 2021-07-27 21:34 豌豆茶
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