07 2021 档案
摘要：1. 项目介绍 在FPGA上最简单的应用就是点亮一盏闪烁的LED。学过软件的朋友一般都写过“Hello world”，因为这个是最简单的程序。 2. 设计要求 LED灯以2s的周期闪烁，LED灯亮、灭，每1s取反一次，如此循环，不断取反。从而实现LED灯的不断闪烁。 3. 设计分析 从外部晶振（50
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摘要：双击Quartus II图标，找到Tools并点击→下拉菜单中有options.→点击General，在右边的下边有Default file location:__________,点击右边的...，选择你想要的默认打开路径即可；最后要关闭软件，重新打开软件（即重启软件），就修改好了。
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摘要：1. 设计要求： 设计一个4位减法器，采用结构化设计。该设计名为sub_4bit，其顶层设计如下图所示，有三个输入量：被减数x[3:0]，减数y[3:0]，低位向本位的借位bin；有两个输出量本位差dif[3:0]，本位向高位的借位bout。数学表达式为：(x + bout) – y – bin =
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摘要：（1）插线顺序 1. 关闭FPGA开发板的电源； 2. 将JTAG仿真器的JTAG线缆连接至FPGA开发板的JTAG接口； 3. 在仿真器的USB接口上插入USB线缆（假设USB线缆的另一段已经插在电脑上）； 4. 打开FPGA开发板的电源。 步骤2和3的最好不要调换，因为虽然FPGA开发板没有供电
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摘要：解决方案： （1）用鼠标右键随意点击顶部的菜单栏，接着就会出现如下的选项，勾选“绘图”选项即可。 （2）然后这个工具栏就会出现在你的界面上了，一般会出现在画面右边。 参考资料：（1）怎样在Visio中画一条直线-百度经验 (baidu.com)
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摘要：1.项目介绍 数值比较器就是对两数A、B进行比较，以判断其大小的逻辑电路。 2. 设计要求： （1）设计一个16位比较器，比较两个数a和b的大小，有三个输出端（大于、小于或等于）。当a大于b，则obig=1，其余为0；当a小于b，则osmall=1，其余为0；当a等于b时，则oequal=1，其余为
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摘要：1. 设计要求： 设计一个4选1多路选择器，数据输入有四个，分别是dataa、datab、datac和datad，还需要一个选择端sel。因为输入有四路数据，选择端要求能够表现出四种状态，因而选择端位宽为2bit。 假设dataa、datab、datac和datad都是位宽为8bit的数据，当sel
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摘要：1. 项目介绍 多路选择器，也叫数据选择器或多路开关，在多路数据传送过程中，能够根据需要将其中任意一路选出来的电路。数据选择器用于控制有效数据的输出，能够通过地址选择线来选定相应的通道作为输出，提高了数据的传输效率。（数据分配器用于数据的传输途径，在信号传输过程中能够通过地址选择线选择传输信道）。
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摘要：问题：仿真的时候看到状态名字，而不仅仅是状态编码？ 1. 另外定义一种寄存器，存放状态变量state_name，长度根据状态名称长度而改变（状态名称字符数x8）；在每个状态执行的语句中加入state_name <= "IDLE"；类似的一句语句；仿真时添加state_name进行观察，使用ASCII
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摘要：1.项目介绍 学习LED数码管的工作原理和编程方法，掌握LED数码管的设计应用。 2.设计要求 利用LED数码管，在数码管上显示0-F字样。系统框图如下图所示。其中，data_in[3:0]为按键输入，seg_n[7:0]为数码管的段选端，sel_n[7:0]为数码管的位选端。 3.实验原理 （1）
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摘要：参考资料（1）(42条消息) 数码管显示字母_老猫的博客-CSDN博客； （2）(42条消息) 8段数码管与字符对照表_蚂蚁取经-CSDN博客
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摘要：1. 共阳型数码管，数码管显示0-f对应的段选输出信号(二进制) 1 parameter NUM0 = 8'b1100_0000, 2 NUM1 = 8'b1111_1001, 3 NUM2 = 8'b1010_0100, 4 NUM3 = 8'b1011_0000, 5 NUM4 = 8'b100
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摘要：1. 共阴型数码管，数码管显示0-f对应的段选输出信号(二进制) parameter NUM0 = 8'b0011_1111, NUM1 = 8'b0000_0110, NUM2 = 8'b0101_1011, NUM3 = 8'b0100_1111, NUM4 = 8'b0110_0110, NU
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摘要：1. 项目简介 呼吸灯，指的是一个LED从暗到亮，从亮到暗逐渐变化，如此循环反复，就像人的呼吸一样有节奏。它采用PWM的方式，在固定的频率下，通过调整占空比的方式来控制LED灯亮度的变化。 PWM（Pulse Width Modulation），即脉冲宽度调制，是一种对模拟信号电平进行数字编码的方法
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摘要：由于vivado的出现以及广泛使用，很多朋友都开始有这种想法：“Vivado使用这么广泛，ISE是不是已经过时了？”其实我觉得vivado和ISE并不是两个对立的开发工具，毕竟vivado和ISE都是xilinx家的。 vivado主要是面向7系列的高端FPGA进行开发，ISE主要是面向低端的FPG
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摘要：1. 设计要求： 设计一个4位二进制数除法器，如下图所示。其中，a[3:0]为被除数，b[3:0]为除数，s[3:0]为商，r[3:0]为余数。 2. 设计原理： 和十进制除法类似，以计算 27 除以 5 的过程为例：除法运算过程如下： (1) 取被除数的高几位数据，位宽和除数相同（实例中是 3bi
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摘要：1. 设计要求： 设计一个4位二进制数乘法器，如下图所示。其中，a[3:0]为被乘数，b[3:0]为乘数，m[7:0]为积，即乘法结果。 注意：为什么乘法结果的有效位数要定义为8位？如：15x15=225。一般情况下，乘法结果的有效位数应为两个乘数位宽之和，从而保证得到正确的结果。 2. 设计原理
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