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摘要： 关于异步复位同步释放的原理不再赘述，直接贴 verilog 代码如下： 综合出的 3 级同步器 RTL 如下图： 参考：https://blog.csdn.net/times_poem/article/details/51866520 https://www.cnblogs.com/yfwblog/ 阅读全文

摘要： 超实用的Windows工具 zd423 - 软件分享平台领跑者 小众软件 精品绿色便携软件 QiuQuan's Blog 果核剥壳 殁漂遥 吾爱破解 无忧启动 Mark Russinovich 蓝点网 1）Listary 类型：搜索 等级：☆☆☆☆☆ 提醒：Listary Pro 是收费的 介绍： 阅读全文

摘要： 关于Verilog 中的for语句的探讨 阅读全文

摘要： 一段式状态机： 1 reg[3:0] cs, ns; 2 always @(posedge clk or negedge rst_n) begin 3 if (!rst_n) begin 4 cs <= IDLE; 5 cmd <= 3'b111; 6 end 7 else begin 8 case 阅读全文

摘要： 异步复位实例： 1 module async_rst ( 2 input din, 3 input clk, 4 input rst_n, 5 6 output reg dout 7 ); 8 9 always @ (posedge clk or negedge rst_n) 10 begin 11 阅读全文

摘要： Verilog基础知识1（FPGA 设计的四种常用思想与技巧之一 -- 乒乓操作） IC设计基础系列之CDC篇12：异步FIFO设计资源推荐 阅读全文

摘要： 1．什么是FIFO？ FIFO是英文First In First Out 的缩写，是一种先进先出的数据缓存器，他与普通存储器的区别是没有外部读写地址线，这样使用起来非常简单，但缺点就是只能顺序写入数据，顺序的读出数据，其数据地址由内部读写指针自动加1完成，不能像普通存储器那样可以由地址线决定读取或写 阅读全文