摘要：
简介在实际的工程中选择复位策略之前必须考虑许多设计方面的问题，如使用同步复位或者异步复位或者异步复位同步释放(Asynchronous Reset Synchronous Release或者Synchronized Asynchronous Reset)，以及是否每一个触发器都需要进行复位。复位的基... 阅读全文
摘要：
时钟多路器用于使同一个逻辑功能具有不同的时钟，比如在通信系统中，为了适应不同的数据速率要求，经常要进行时钟切换。有时为了节约功耗，也会把高速时钟切换到低速时钟，或者进行时钟休眠操作。下图是某一类型的时钟多路器：虽然在时钟信号上引入多路逻辑会产生毛刺等问题，但是在不同的应用中，对多路时钟的要求区别很大。时钟切换的最佳途径是使用FPGA内部的专用Clock MUX，这些MUX的反应速度快，锁定时间短，... 阅读全文
摘要：
双沿时钟双沿时钟是指在时钟的上升沿和下降沿都传输数据，这样使得数据传输在给定的时钟速率下能达到双倍的吞吐率，下图是一个由双沿时钟触发电路：使用双沿时钟可能存在一些问题，时钟的非对称占空比可能导致违背建立和保持时钟，而且很难确定关键信号的路径。下图是时钟驱动的单沿数据传输和多沿数传输波形图：在对性能和速度要求很高的情况下，并且无法承受使用等效同步电路在DFT和验证方面所带来的额外开销外，可使用双... 阅读全文
摘要：
行波计数器行波计数器是指每个寄存器的输出引脚连接到下一级寄存器的时钟引脚上，如下图所示：用触发器来驱动其他触发器的时钟输入端，一般都会存在问题。由于每个寄存器都存在传播延迟，且每一级触发器时钟的延迟会使下一级触发器的输入时钟产生偏移，会造成累积延迟，如下图所示。行波计数器对于静态时序分析是一个巨大的挑战，因为行波计数器中的每个阶段都产生了一个新的时钟，这就需要静态时序工具处理更多的时钟域，从而... 阅读全文