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01 2016 档案
I2C 总线协议
摘要：摘自 <<I2C-bus specification and user manual>> Rev. 6 -- 4 April 2014 1 features 1) two bus lines: SCL, SDA 2) each device is software addressable 3) mu
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Verilog (二) multiplexer and decoder
摘要：1 mutiplexer 数据选择器 1) one-bit wide 2-1 mux 2) 4-1 mux 3) two-bit wide 8-1 mux (case statement) 2 decoder 解码器/译码器 n 个输入 => 2n 个输出 1) 3-8 binary decoder
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有限状态机HDL模板
摘要：逻辑设计, 顾名思义, 只要理清了 逻辑 和 时序, 剩下的设计只是做填空题而已。 下面给出了有限状态机的标准设计，分别为 VHDL 和 Verilog 代码 1 有限状态机 2 VHDL模板一 3 Verilog模板一 参考资料： <Circuit Design with VHDL> chapte
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