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记录硬件相关的知识
system generator学习笔记【02】
摘要：作者：桂。 时间：2018-05-20 23:28:04 链接：https://www.cnblogs.com/xingshansi/p/9059668.html 前言 继续学习sysgen。接触system genenrator初步学习的有四点： 1）基本模块的搭建，这是sysgen的基本组成要素 阅读全文
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system generator学习笔记【01】
摘要：作者：桂。 时间：2018-05-18 18:26:50 链接：http://www.cnblogs.com/xingshansi/p/9045914.html 前言 学习使用system generotor，并将学习内容整理成笔记。 MATLAB与VIVADO版本配对：https://www.xi 阅读全文
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硬件资源拆解
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基础008_定浮点转化[floating point IP]
摘要：作者：桂。 时间：2018-05-15 21:55:50 链接：http://www.cnblogs.com/xingshansi/p/9042564.html 前言 本文为Xilinx floating point IP的学习笔记，仅记录最基础的用法。参考文档：pg060-floating-poi 阅读全文
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Xilinx 常用模块汇总(verilog)【04】
摘要：作者：桂。 时间：2018-05-15 13:07:02 链接：http://www.cnblogs.com/xingshansi/p/9040472.html 前言 Xilinx 常用模块汇总(verilog)【01】 Xilinx 常用模块汇总(verilog)【02】 Xilinx 常用模块汇 阅读全文
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DUAL PORT RAM应用实例
摘要：作者：桂。 时间：2018-05-14 12:11:00 链接：http://www.cnblogs.com/xingshansi/p/9035522.html 前言 主要是Xilinx 常用模块汇总(verilog)【03】中双端口RAM的细节补充，限于篇幅，单独列出。 一、双端口RAM简述 具体 阅读全文
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基础007_FIFO原理
摘要：作者：桂。 时间：2018-05-13 05:51:13 链接：http://www.cnblogs.com/xingshansi/p/9030879.html 前言 主要梳理FIFO的特性，fifo类似一个人的肚子，饿了就吃（write），吃完一段时间后就拉（read），，吃饱就满了（full）， 阅读全文
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格雷码(Gray code)仿真
摘要：作者：桂。 时间：2018-05-12 16:25:02 链接：http://www.cnblogs.com/xingshansi/p/9029081.html 前言 FIFO中的计数用的是格雷码，简要记录格雷码的分析思路。 一、格雷码与8421码对应关系 通过真值表分析，可以得出： 即格雷码是：8 阅读全文
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FIFO深度计算
摘要：作者：桂。 时间：2018-05-12 13:02:58 链接：http://www.cnblogs.com/xingshansi/p/9028429.html 前言 学习、记录FIFO深度计算的原理及方法。 FIFO深度计算.pdf 一、深度计算原理 基本准则： 二、典型示例 另外： input: 阅读全文
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Xilinx 常用模块汇总(verilog)【03】
摘要：作者：桂。 时间：2018-05-10 2018-05-10 21:03:44 链接：http://www.cnblogs.com/xingshansi/p/9021919.html 前言 主要记录常用的基本模块。 Xilinx 常用模块汇总(verilog)【01】 Xilinx 常用模块汇总(v 阅读全文
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常用器件乘法器性能比较
摘要：作者：桂。 时间：2018-05-08 19:41:28 链接：http://www.cnblogs.com/xingshansi/p/9010558.html 前言 简要记录常用器件乘法器性能。 器件资料： A10：overview S10：overview dsp 7series：overvie 阅读全文
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Xilinx 常用模块汇总(verilog)【02】
摘要：作者：桂。 时间：2018-05-08 18:35:56 链接：http://www.cnblogs.com/xingshansi/p/9010282.html 【本文遗留几处细节问题，待闲下来解决。 其中多处涉及原语，以后若有需要，进一步了解可参考文档：hdl.pdf + CLB.pdf。】 一、 阅读全文
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Xilinx 常用模块汇总(verilog)【01】
摘要：作者：桂。 时间：2018-05-07 19:11:23 链接：http://www.cnblogs.com/xingshansi/p/9004492.html 前言 该文私用，不定期更新，主要汇总记录Xilinx常用的基本模块，列出清单，方便查阅。 关于原语，主要参考【原语时序为什么好，一个猜想是 阅读全文
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Vivado抓取信号
摘要：作者：桂。 时间：2018-05-03 21:16:03 链接：www.cnblogs.com/xingshansi/p/8987608.html 前言 FPGA调试需要抓取特定信号，一个直观的思路是：保存抓取的信号，事后分析/ 或者 导出实测数据，用作后续算法仿真验证。 本文简要记录数据的导出及读 阅读全文
posted @ 2018-05-03 21:27 LeeLIn。 阅读(4177) 评论(0) 推荐(0) 编辑
数据同步【综述】
该文被密码保护。
posted @ 2018-04-21 15:17 LeeLIn。 阅读(6) 评论(0) 推荐(0) 编辑
三阶交调
摘要：作者：桂。 时间：2018-03-26 23:18:58 链接：http://www.cnblogs.com/xingshansi/p/8654795.html 前言 接收机中，人们总希望同时获得高灵敏度和大动态范围，遗憾的是，在接收机中增益越高（灵敏度越高）则三阶截点越低（动态范围越小），结果是： 阅读全文
posted @ 2018-03-26 23:34 LeeLIn。 阅读(11714) 评论(0) 推荐(0) 编辑
基础005_V7-Select IO
摘要：主要参考ug471.pdf。 阅读全文
posted @ 2018-02-12 14:42 LeeLIn。 阅读(254) 评论(0) 推荐(0) 编辑
基础004_V7-DSP Slice
摘要：主要参考ug479.pdf。之前的文章：FIR调用DSP48E_05。本文主要记录基本用法。 一、DSP48核 A-参数说明 instrctions，多个功能，通过sel选用 目前没发现C勾选与否，有何影响。 如上图所示，结果3拍后输出： 其他参数： B-IP调用 生成IP核，参数设置完毕直接调用即 阅读全文
posted @ 2018-02-12 09:38 LeeLIn。 阅读(1069) 评论(0) 推荐(0) 编辑
基础003_V7-Memory Resources
摘要：一、综述 参考ug473.pdf。 常用Memory 资源： 在IP核中，Block memory（distributed memory为CLB中的资源）： 通常选用Native，而不用AXI接口： Block RAM可配置单端口RAM、伪双端口RAM、双端口RAM、单端口ROM、双端口ROM、FI 阅读全文
posted @ 2018-02-08 16:19 LeeLIn。 阅读(879) 评论(0) 推荐(0) 编辑
基础001_Xilinx V7资源
摘要：作者：桂。 时间：2018-02-08 09:37:35 链接：http://www.cnblogs.com/xingshansi/p/8430247.html 前言 本文主要是Xilinx V7系列的零碎记录，以便查阅。 一、器件资料 主要参考《Xilinx新一代FPGA设计套件VIVADO应用指 阅读全文
posted @ 2018-02-08 11:01 LeeLIn。 阅读(1691) 评论(0) 推荐(0) 编辑

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