随笔分类 - IC开发记录
摘要：RTL常用逻辑写法 判断两数之差等于1 assign bma_eq_1 = (b[11:0]-a[11:0] == 1'b1) 与下面的逻辑等效： assign bma_eq_1 = &(({b[10:0] | ~a[10:0], 1'b0}) ^ (b[11:0] ^ a[11:0])) 加1减1
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摘要：目录1. Verdi代码界面的有用操作1.1. 快速定位某个模块1.2. 搜索源代码1.3. 在代码中显示信号数值1.4. 永久设置verdi字体1.5. 启动verdi时指定波形和rc1.6. 显示等效的信号或者信号定义2. Verdi看波形的常用操作2.1. 快捷键2.2. 鼠标2.3. 其他3
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摘要：1、基本语法 2、示例 2.1 编译C和C++ 运行make compile_c或者make compile_c_plus将生成可执行文件mian.o Makefile由浅入深--教程、干货： https://zhuanlan.zhihu.com/p/47390641
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摘要：目录综合后的网表功能与RTL不对关于+neg_thckRound问题PR后的网表反标SDF功能不对 综合后的网表功能与RTL不对 1、VCS仿真选项+nospecify和+notimingcheck没打开，注意后仿（带sdf）时应该将+nospecify去掉 2、有的模块没接上复位信号，用VCS仿真
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摘要：目录VCS及VERDI工具环境设置VCS编译命令VCS仿真选项FSDB波形控制相关系统函数初始化memory将信号写入文本在initial中调用task使用force + generate for语句对generate for语句块生成的实例（RAM）进行初始化 VCS及VERDI工具环境设置 se
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摘要：目录正则表达式-匹配正则表达式-替换数组哈希其他一些有用的脚本例化Verilog模块 正则表达式-匹配 1、匹配：m/ /(与qw//操作一样可以使用任何成对的分隔符，如(),<>,{},[],!!,还可以简写为//，略去m) 2、=~ 表示匹配，!~ 表示不匹配。如：if ($string =~
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摘要：目录terminal相关更改终端字体大小快捷键在各个terminal间切换更改terminal的名字环境配置安装或者更新package文件处理查找文件查看文件大小批量修改文件名字压缩与解压删除nfs文件grep相关sed命令替换删除插入及追加打印处理文件批量查找并替换文件夹下所有文件的内容du(di
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摘要：目录常用设置快捷键特殊符号录制快速注释or取消注释快速选中、删除、复制引号或括号中的内容正则表达式-捕获匹配的变量统计某个单词出现的次数二进制文本处理 Gvim基础操作(正则表达式)-02 常用设置 colorscheme evening set nu set linespace=2 set lin
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摘要：1、 安装 先取消文件 mgls64.dll 的只读属性 把MentorKG.exe和patch_dll.bat一起拷贝到modelsim安装目录的win32或win64下（modelsim一定要在这个目录下） 运行patch_dll.bat，产生license后，放到任意目录下 设置环境变量MGL
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摘要：1、OrCAD Capture CIS绘制原理图 1.1、快捷键 (1)放置连线 w (2)放置net名称 n 放下一个时再按n可以编辑名字 (3)编辑属性 ctrl + e 1.2、常用操作 (1)添加元件库 左侧工程目录，选中library，右键Add File (2)元器件编号 Tools-A
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摘要：1.删除文件 file delete A file delete -force A 2.建立文件夹 file mkdir A file mkdir A/A 3.判断文件夹是否存在 file exist A 4.复制文件 file copy A B 5.函数 proc fun {args} { put
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摘要：Verdi代码界面的基本操作小结： （1）快速定位某个模块 在vedi左侧层次浏览器窗格鼠标右键 -> Show Search/Filter(CTRL+F) -> 输入字符串搜索（例如*ircu*）-> 回车（多按几次） （2）搜索源代码 https://zhuanlan.zhihu.com/p/8
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摘要：一、常规网表 二、直流分析网表 打开生成的.sw0文件可以看到如下的波形： Ids: Vd: Vg:
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