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2020年10月21日
[转]使用Altium Designer软件铺铜后再挖铜
摘要: https://blog.csdn.net/qq_35605018/article/details/106169497 https://jingyan.baidu.com/article/656db91881ff72e381249c1d.html https://blog.csdn.net/sugu
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posted @ 2020-10-21 09:33 tubujia
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2020年10月20日
[转]关于STM32 PB3 PB4 如何设置成普通GPIO的配置
摘要: https://blog.csdn.net/love33521/article/details/8308036 http://news.eeworld.com.cn/mcu/article_2016100830219.html 对于初学习者来说为什么用到PB3和PB4时无法控制输出呢? 下面就这一问
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posted @ 2020-10-20 17:53 tubujia
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2020年10月15日
[转]Verilog有符号数与无符号数作运算
摘要: https://www.cnblogs.com/lyc-seu/p/12533226.html https://blog.csdn.net/vivid117/article/details/101427302 http://wscentity.lofter.com/post/1d00edbd_647
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posted @ 2020-10-15 09:49 tubujia
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2020年10月14日
[转]实用光电二极管pd的采样电路
摘要: https://blog.csdn.net/weixin_38345163/article/details/105102177?utm_medium=distribute.pc_aggpage_search_result.none-task-blog-2~all~first_rank_v2~rank
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posted @ 2020-10-14 10:46 tubujia
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2020年9月29日
STM32外部8M晶振不启动
摘要: 新焊接的板卡,测试8M晶振不起,网上查原因:空的STM32外部晶振不起,烧写程序后会起。 参考: http://www.openedv.com/posts/list/36355.htm http://www.classnotes.cn/3742.html 靠谱解释: 修改stm32f10x.h文件中
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posted @ 2020-09-29 11:27 tubujia
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2020年9月24日
ALTCLKCTRL核的作用
摘要: ALTCLKCTRL,最简单的一个作用是假设你硬件上时钟没有从全局管脚进入,是无法给到PLL的。添加该IP后,IP的输出时钟即布到了全局时钟网络,而后再给PLL输入可用。
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posted @ 2020-09-24 09:42 tubujia
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2020年9月23日
[转]如何在Altium Designer中将PCB生成PDF?
摘要: 原文地址: https://blog.csdn.net/jbb0523/article/details/6803882
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posted @ 2020-09-23 15:01 tubujia
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2020年9月15日
UDP千兆以太网FPGA_verilog实现(二、知识搜集)
摘要: https://blog.csdn.net/ciscomonkey/article/details/83995353
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posted @ 2020-09-15 12:56 tubujia
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2020年8月2日
[转]stm32 SWD调试接口的使用
摘要: https://blog.csdn.net/u012247418/article/details/86021706
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posted @ 2020-08-02 12:42 tubujia
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2020年5月22日
[原]qsys互联空间与IP核内部的地址关系
摘要: 1、在IP核内部,地址线指的是以字为单位的。 如一个ram,数据线宽度为32bit,地址线宽度为14bit,该ram的容量为2^14=16384个字,每个字4字节,即64KB。在qsys互联空间内,该ram的地址空间是0~FFFF,因此qsys是以字节为单位互联的。 2、制作一个avalon-mm
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posted @ 2020-05-22 15:02 tubujia
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