Verilog设计中如何匹配变量的位宽？（$clog2系统函数）
taylorrrrrrrrrr 2024-07-24 11:12
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我的随笔
PGA开发技巧：Modelsim仿真.do文件详细解析 原创 -特权同学
taylorrrrrrrrrr 2024-07-22 13:58
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Notepad++文本比较插件：Compare（重要的是免费）
taylorrrrrrrrrr 2024-07-19 15:32
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@（posedge clk）表示的是clk上升沿这个事件
taylorrrrrrrrrr 2024-07-17 16:11
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[Vivado 12-4473] Detected error while running simulation. Please correct the issue and retry this operation.
taylorrrrrrrrrr 2024-07-11 15:33
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Modelsim观察波形--基础操作
taylorrrrrrrrrr 2024-07-08 15:27
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OV5640摄像头 FPGA'
taylorrrrrrrrrr 2024-07-08 15:04
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