2012年2月16日
基于verilog的FPGA设计【小技巧】
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posted @ 2012-02-16 16:33 一叶扁舟0o 阅读(6) 评论(0) 推荐(0) 编辑
quartus 如何编译"child_module"以及设置顶层文件来避免工程名与模块名不一致的情况！
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posted @ 2012-02-16 14:12 一叶扁舟0o 阅读(3) 评论(0) 推荐(0) 编辑
quartus ii把编译窗口的标签栏隐藏了，怎么恢复.
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posted @ 2012-02-16 13:45 一叶扁舟0o 阅读(2) 评论(0) 推荐(0) 编辑