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2020年8月17日
奇数分频--不使用负边沿触发verilog实现(占空比50%)
摘要: 奇数分频电路的代码,有两种情况:①使用带负沿触发的DFF(要求占空比50%),②不使用带负沿触发的DFF; 使用带负边沿触发的:https://www.cnblogs.com/shadow-fish/p/13383903.html 不适用带负边沿触发:实质是向带负边沿触发的DFF靠拢。实验程序为3分
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posted @ 2020-08-17 20:07 影-fish
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