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知明而行无过
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2017年5月18日
乘法器的Verilog HDL实现(转载)
摘要: 原文地址:http://www.cnblogs.com/shengansong/archive/2011/05/23/2054401.html 1. 串行乘法器 两个N位二进制数x、y的乘积用简单的方法计算就是利用移位操作来实现。 乘法功能是正确的,但计算一次乘法需要8个周期。因此可以看出串行乘法器
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posted @ 2017-05-18 12:54 知明而行无过
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