摘要:Qsys其中之一的賣點就是允許你建立hierarchical的subsystem。在SOC設計中,通常我們會將慢速的周邊使用較慢的clock而自成一個系統,在Qsys中允許我們將這些較慢的周邊包成一個peripheral subsystem,而不是像SOPC Builder一樣只能有一個system。當我們使用subsystem的架構時,該如何讓subsystem內IP使用interrupt的方式與Nios II溝通呢?
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摘要:SOPC最可貴之處就是它的彈性,所以儘管已經建立了Nios II SBT project,你還可以去更改FPGA的RTL或者Qsys的架構與IP,此時Nios II SBT project該做哪些步驟才能反映出更改過的硬體架構呢?是該Generate BSP?還是該BSP Editor?或者該Build Project?其執行順序又是如何呢?
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摘要:
若我們從網路上下載範例程式,或者從書上的光碟將範例程式複製到硬碟時,只要是Quartus II版本正確,都可以正常地開啟Quartus II project並且編譯之,但Nios II project卻常常雖然能開啟,卻無法正常編譯,本文討論其root cause並提出解決方式。
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摘要:若要對含有Nios II的SOPC系統進行simulation,在Qsys的Generation Tab有新的設定,本文討論其設定的意義。
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摘要:這是我第一次參加Altera一年一度的Technology Roadshow。
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摘要:Quartus II改版很快,我需要一直更新Quartus II版本嗎?SP的版本我也需要更新嗎?我該如何得知新版的Quartus II改了哪些東西?
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摘要:Altera即將在2012年停止使用SOPC Builder,取而代之是Qsys,除了在Quartus II 11.0正是提供Qsys之外,Altera亦開始只提供Qsys的範例程式,所以學會Qsys已經成為不可擋的趨勢,除非你不想跟隨Altera的技術繼續進步。
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摘要:
朋友看我花了快台幣三萬元買了買了DE2-70 + 500萬像素CMOS數位相機 + 4.3"LCD觸控式面板,問我買FPGA開發版能幹麻?還不如去買iPhone 4(雖然我也是有買iPhone 4),其實DE2-70比iPhone 4更好玩。
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摘要:
在上一篇blog,我們學會了將wav檔放在SD卡上,實做出一個SD卡wav player,第一次體會出軟硬體設計的威力。由於FAT16格式的讀取,必須牽涉到軟體的動作,所以必須引入Nios II與Avalon Bus,不能再靠純硬體的方式設計。這次我們將圖片放在SD卡上,在DE2-70實做出一個簡易的數位相框。
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摘要:
在上一篇blog,我們學會如何開發一個硬體Controller,並加上軟體API,讓Nios II軟體能順利地控制硬體,並且讓七段顯示器從0屬到100。或許由同學會問:『要讓七段顯示器從0數到100,我用純硬體的方式開發,全部的Verilog程式碼不超過50行,為什麼要大費周章的使用軟硬體設計的方式呢?還要多學了SOPC Builder、Avalon Bus、Nios II,增加學習曲線,執行速度也比純硬體慢,FPGA所使用的資源(LE)也比純硬體多很多!!』 本Lab是軟硬體設計的精典範例,你將會感受出軟硬體設計的威力。
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摘要:
在上一篇blog,我們已經學會如何將Altera內建的controller加上SOPC Builder,並且用軟體來控制硬體,儘管如此,你會發現在DE2-70上,仍然有很多硬體還沒被驅動,如VGA、LTM、CMOS、Ethernet、Audio CODEC、七段顯示器...等,此外,雖然現在軟體能控制硬體了,卻必須依賴Altera所提供的controller,只要Altera沒提供controller,我們就沒辦法去控制該硬體。在本文中,我們將自己實做出一個Altera沒提供的controller:七段顯示器controller,使七段顯示器能被Nios II軟體所控制,其中包含硬體controller與軟體HAL的開發。
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摘要:
本文使用Quartus II、SOPC Builder、Nios II EDS從0開始打造一個能在DE2-70上跑μC/OS-II的Nios II系統,初學者可借此範例熟悉Quartus II、SOPC Builder、Nios II EDS的使用,並且了解基於FPGA的嵌入式系統開發流程。
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摘要:
當我們在μC/OS-II使用Multi Thread時,會將程式包在task內,但要如何將參數傳到task內呢?
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摘要:
一直有人反應無法在DE2-70使用SSRAM,主要是top module接法的錯誤,本文提出解決方法。
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摘要:Nios II常會出現『Error parsing project STF file』錯誤訊息,該如何解決呢?
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摘要:
在DE2-70,隨便一個Nios II系統在Quartus II編譯後,幾乎都會遇到1個critical warning:『Critical Warning: Timing requirements for slow timing model timing analysis were not met. See Report window for details.』,該如何解決呢?
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摘要:Quartus II是一個功能強大,但也非常複雜的軟體,初學者常常迷失在Quartus II眾多功能中,Altera提供了在線技術培訓視頻供初學者學習,重點是:『全中文』!!
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摘要:
使用Altera所提供的ip時,如UART、DMA...等,只要在SOPC Builder加進要用的ip,Nios II的C語言include正確的header file後,就可以正常使用,為什麼自己寫的ip,還必須將HAL的*.c複製到project的目錄下才能編譯呢?
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摘要:雖然在blog談了不少Nios II的技術,但一直還沒有推薦過任何一本Nios II書籍,對於初學者來說,若能確確實實熟悉本書的內容,就可以快速的將Nios II功力提升到中級的水準。
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摘要:本文介紹破解Quartus II 8.1詳細步驟。
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