01 2024 档案
摘要:软件版本:vitis2021.1(vivado2021.1) 操作系统:Ubuntu18.04 硬件平台:适用XILINX A7/K7/Z7/ZU/KU系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1.1概述 基于XILINX XDMA的开发应用环境需要用
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的低功耗设计,需要掌握几种低功耗设计的方法。 2低功耗简介 低功耗技术在当今得到越来越广泛的发展,在你的身边
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节主要讲解Verilog语法的FIFO设计,需要掌握FIFO的基本原理,掌握同步FIFO和异步FIFO的结构。 2同步FIFO FI
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的时钟分频设计,需要掌握时钟的特性,以及如何进行时钟分频设计。 2时钟分频 在FPGA的硬件电路设计中,PC
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的复位设计,需要掌握复位电路的同步复位、异步复位、异步复位同步化和异步复位同步释放。 2复位电路简介 为确保
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节主要讲解Verilog语法的跨时钟域设计,需要掌握跨时钟域时快慢时钟之间信号是如何同步的。 2跨时钟域慢速到快速时钟 由慢时钟到快
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节主要讲解Verilog语法的同步与异步设计,需要掌握同步时钟和异步时钟的设计方法。 2同步时钟 数字电路设计中,一般认为,频率相同
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的流水线设计,需要掌握流水线的设计方法。 2流水线简介 2.1 什么是流水线 流水线的基本思想是:把一个重复
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的仿真文件设计,需要掌握testbench的建立方法。 2仿真文件设计 当完成verilog工程设计后,首先
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的函数与任务,需要掌握具体的task和function语句的使用方法。 2函数与任务 task和functi
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的一般设计规范,需要掌握时序或组合电路设计中需要注意的几点,掌握设计避免出现锁存器。 2设计规范 上一节课我
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节主要讲解Verilog语法竞争与冒险,需要掌握竞争与冒险的概念以及消除方法。 2竞争与冒险 2.1 什么是竞争与冒险 在数字电路设
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本小节讲解Verilog语法的模块端口与例化的方法,需要掌握模块的端口的类型,以及有几种例化方式。 2模块端口 模块在介绍设计方法时有提
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节主要讲解Verilog语法条件、循环语句,需要掌握if、case、casex、casez、while、for、repeat、fore
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节讲解时序控制语句相关的语法与几种语句块的使用介绍,需要掌握时序控制的规则和顺序块、并行块、命名块、嵌套块的使用。 2时序控制简介 V
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节主要讲解过程结构与赋值,需要掌握阻塞和非阻塞赋值的区别。 2过程结构 过程结构语句有两种,initial 与 always 语句。它
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节主要讲解Verilog的数据类型和表达式。 2数据类型 Verilog中主要有两种数据类型:变量(variable)和线网(net)
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节主要讲解基础语法,包含语法格式、注释、标识符、关键字、数值种类与表示和字符串。 2语法简介 2.1 格式 Verilog 语言是区分
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节主要讲解Verilog的基本设计方法及设计流程。 2基本设计方法 Verilog的设计方法有两种,一种采用自上而下的设计方法,另一种
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摘要:软件版本:无 操作系统:WIN10 64bit 硬件平台:适用所有系列FPGA 登录"米联客"FPGA社区-www.uisrc.com视频课程、答疑解惑! 1概述 本节主要介绍Verilog HDL的特点,发展历史及现状,主要应用场景。 2 Verilog HDL简介 Verilog HDL是一种硬
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摘要:1.1 概述 为了方便用户使用,vivado中提供了一个IBERT(Integrated Bit Error Ratio Tester)的测试工具用于对Xilinx FPGA芯片的高速串行收发器进行板级硬件测试。通过IBERT我们可以直接获取误码率,观察眼图,调节串行收发器的参数,从而有助于判断可能
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摘要:1.1概述 本实验内容下载已经编译好的网口测试bit 和ltx文件,对pl端lan测试 1.2外设资源 1.3配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是 1.4 JTAG接线
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摘要:1.1 概述 本实验内容下载已经编译好的PL DDR测试bit 和ltx文件,对DDR测试 1.2 外设资源 1.3 配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是 1.4 JT
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摘要:1.1 概述 本实验内容下载已经编译好的HDMI测试bit 和ltx文件 1.2 外设资源 1.3 配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是 1.4 JTAG接线 JTAG
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摘要:1.1 概述 本实验内容下载已经编译好的hc595测试bit ,对hc595测试 1.2 外设资源 1.3 配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是 1.3 JTAG接线
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摘要:1.1概述 本实验内容下载已经编译好的rs485测试bit ,对rs485测试 1.2外设资源 1.3配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是 1.3 JTAG接线 JTA
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摘要:1.1概述 本实验内容下载已经编译好的usb232测试bit,对usb232测试 1.2外设资源 1.3配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是 1.4 JTAG接线 JT
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摘要:1.1 概述 本文以提供的固化文件为例,演示如何利用 VIVATO 固化 FLASH。 文件路径如下: 1.2 外设资源 1.3 配件准备 为确保本实验可以完成,需要使用以下配件,请确认你是否已经购买了相关配件。 物品数量标配/选配实物图是否使用F9开发板1标配是电源1标配是JTAG下载线1标配是1
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