随笔分类 - RISCV
摘要：什么是linker relaxations 由于链接时携带一些符号地址信息，可以执行一些编译时难以或者不大可能实现的优化。Linker Relaxtion 与传统编译时期的优化是不一样的，此优化发生在链接时。通常情况下，在链接时，改变代码的执行序列是有风险的，因为语义信息此时会丢失，链接器看到也仅是
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摘要：riscv没有sev/wfe指令，当前无法在spinlock时省功耗，只能通过while循环不断检查条件。 本文分析linux内核下对于spinlock的实现，具体到RISC-V体系结构。由于RISC-V体系结构下目前只是简单的实现了一个基于TAS的最基本的spinlock，本文的另一个附加任务就是
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摘要：1.Introduction 正如本篇文章所说，在非特权ISA设计中，我们试图消除对特定微体系结构特性的任何依赖(如如缓存线大小)，或特权体系结构细节的任何依赖(如页面翻译)。这既是为了简单，也是为了给可选微架构或可选特权架构提供最大的灵活性。 term 名词 解释 core 一个组件如果具有取指单
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摘要：官网 https://github.com/riscv-collab/riscv-gnu-toolchain 编译器 基于RISC-V交叉编译器包括32bit和64bit两种类型，其中每种类型又包括裸机版本（newlib）和动态链接库版本（linux glibc） newlib ./configur
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摘要：> RISC-V SBI SPEC https://github.com/riscv-non-isa/riscv-sbi-doc/blob/master/riscv-sbi.adoc # 什么是SBI RISC-V Supervisor Binary Interface Specification
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摘要：本文基于官方spec进行整理学习 https://wiki.riscv.org/display/HOME/RISC-V+Technical+Specifications 特权模式spec讲了啥，内容有哪些 特权模式的软件视角 软件分层：AEE/SEE/HEE 特权等级：User/Supervisor
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摘要：# RISC-V - 官网地址 https://riscv.org/ - RISC-V标识 > Always use: RISC-V, RISC-V International > Never use: Risc V, RISC V, RISC_V # 开源和开放标准的重要性 技术不是孤立存在的，随
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