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2015年8月26日

systemverilog 基础

摘要: 转一篇Systemverilog的一个牛人总结: http://blog.sina.com.cn/s/blog_5e9b181a010188re.html 1、合并数组和非合并数组 1)合并数组: 存储方式是连续的,中间没有闲置空间。 例如,32bit的寄存器,可以看成是4个8bit的数据,或者也可 阅读全文

posted @ 2015-08-26 23:15 hematologist 阅读(379) 评论(0) 推荐(0) 编辑

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