摘要：
本文参考： SystemVerilog静态变量和动态变量_行走的BUG永动机的博客-CSDN博客_systemverilog静态变量和动态变量 systemverilog之Automatic - 腾讯云开发者社区-腾讯云 (tencent.com) https://blog.csdn.net/zha 阅读全文
摘要：
本篇随笔参照vcs user guide，并进行了一个小实验用以加深理解。 在芯片前端开发的后期，验证工程师需要进行xprop仿真验证，之前我只是简单的打开xprop的功能，去回归一些case看会不会fail并进行debug。但是对为什么要进行xprop验证理解的并不是很清楚。 下面是一些我自己的理 阅读全文
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class hash160; parameter H0=32'h67452301; parameter H1=32'hefcdab89; parameter H2=32'h98badcfe; parameter H3=32'h10325476; parameter H4=32'hc3d2e1f0; 阅读全文
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转载自：https://www.cnblogs.com/xinlukk/p/7401635.html 博主：小猫种鱼 " Vim syntax file " Language: SystemVerilog " Maintainer: Stephen Hobbs <stephenh@cadence.c 阅读全文
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RSA 基本原理： 选取两个不同的大素数p、q，并计算N=p*q，选取小素数d，并计算e，使d*e % (p-1)(q-1)=1，对于任意A<N：若B=A**d % N则A=B**e % N 可见d、e形成了非对称秘钥关系，加密者用公钥d加密，解密者可用私钥e解密，第三者即使拦截了密文B、公钥d和N 阅读全文
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模运算： 定义：A Mod B=A-(A div B) * BC++表示：a % b = a - b * (a / b) mod 与 & 的转换：x % 2n == x & (2n - 1)例： (假设x是整数):x % 2 == x & 1x % 4 == x & 3x % 8 == x & 7运 阅读全文
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方案1： 1. 准备c文件, cprog.c： #include<stdio.h> void echo(char* str){ printf("chaogang test\n"); printf("test str %s\n",str); } 2. 通过vcs去编译该c文件： 3. 在sv中想要使用 阅读全文
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= 是最基本的赋值:= 即时展开右边的变量，= 是在parse所有的makefile之后最后再展开变量值?= 是如果没有被赋值过就赋予等号后面的值+= 是添加等号后面的值，是否即时展开右边的变量，取决于变量是=复制还是:=赋值 1、“=” make会将整个makefile展开后，再决定变量的值。也就 阅读全文
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本文摘抄自：https://blog.csdn.net/gulang03/article/details/81175854 代码是根据参考的博客中的算法自己手撸的。 1 typedef bit[3:0][7:0] Matrix[4]; 2 class aes_encrypt; 3 bit[15:0] 阅读全文
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参考：https://www.cnblogs.com/xiaoxie2014/p/14445543.html vim中的正则表达式： . 匹配任意字符 [abc] 匹配方括号中的任意一个字符，可用-表示字符范围。如[a-z0-9]匹配小写字母和数字 [^abc] 匹配除方括号中字符之外的任意字符,^ 阅读全文