7系列FPGA远程更新方案-QuickBoot（转）
摘要：reference： http://xilinx.eetrend.com/d6-xilinx/article/2014-04/7009.html reference : quickboot method for fpga design remote update.pdf 一、概述对于成熟的电子产品，
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posted @ 2018-11-15 15:56
随笔分类 - FPGA设计方法
对于FPGA使用过程中，遇到的问题进行积累；总结和学习一套设计方法，加速项目推进。
理解K系列与ultra-scale的区别
摘要：总结： K系列FPGA与KU系列FPGA的主要区别，体现在： （1）工艺制程不一样，K-28nm，KU-20nm； （2）Ultra-Scale采用SSI；大容量K系列也采用SSI，SSI为了解决资源过多，使用多块硅片 ； （3）KU资源更多，性能更高； Introduction to the Ul
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posted @ 2018-10-17 10:54
vivado自动化tcl实现（更新中）
摘要：ug1197-vivado-high-level-productivity vivado中如何使用自动化工具进行设计？用过的项目有AD9361提供的官方例子中，使用了自动化方式，可以借鉴。
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posted @ 2018-10-17 09:23
用FPGA对ASIC进行原型验证的过程（转）
摘要：用FPGA对ASIC进行原型验证的过程 reference：http://xilinx.eetrend.com/d6-xilinx/article/2018-10/13736.html 鉴于芯片设计的复杂度提升， 成功设计一个芯片所牵扯的步骤与过程也愈加复杂，所需花费的资金也成倍增加，一个典型的芯片
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posted @ 2018-10-16 11:30
对单脉冲跨时钟域的处理方法
摘要：在FPGA开发设计中，经常是多个时钟同时工作于同一模块中，不同时钟域的信号间要保证稳定通信，必须要处理好时序问题，也就是要充分考虑信号的建立和保持时间，以下是在设计中常用的单脉冲信号的处理方法： r_PULSE_O <= { r_PULSE_O[1:0] , r_PULSE_I} ; 理论上，相当于
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posted @ 2018-10-11 14:48
FPGA复位的可靠性（转）
摘要：FPGA复位的可靠性（同步复位和异步复位） reference:http://www.eetop.cn/blog/html/17/743817-24442.html 一、特点： 同步复位：顾名思义，同步复位就是指复位信号只有在时钟上升沿到来时，才能有效。否则，无法完成对系统的复位工作。用Verilo
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posted @ 2017-05-16 15:43
FIFO的使用总结
摘要：使用FIFO积累 （1）FIFO作为跨时钟域使用； 多bit位宽，尽量使用FIFO进行跨时钟域；如果仅仅是打两拍解决的话，会引起vivado布线困难；造成临近逻辑不稳定； 避免过约束引起的时序问题； （2）FIFO作为数据位宽转换使用； 一般在同一时域下不必用FIFO作为位宽的转换；若跨时钟域可以采
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posted @ 2016-11-11 11:16
