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2019年5月19日
系统时钟的配置
摘要: 对Figure7-4的说明: 上电时,PLL没被启动,FCLK等于外部输入时钟,称为Fin。 1 上电几毫秒后,晶振(OSC)输出稳定,FCLK = Fin,nRESET恢复高电平后,CPU开始执行指令。 2 设置MPLL,等待Lock Time(使MPLL输出稳定),MPLL稳定输出,CPU工作于新的工作频率(在Lock Time期间,FCLK停震,CPU停止工作)。 具体的配...
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posted @ 2019-05-19 14:38 Lilto
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