关于verilog中小数直接赋值

verilog中小数直接赋值的话小数会近似成1,如0.1,0.6,0.9赋值的话就会变成1,5.1,5.9也都会变成6.并且quartus默认小数是64位。

posted @ 2014-09-12 13:59  lianjiehere  阅读(2608)  评论(0编辑  收藏  举报