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11 2016 档案

verilog断言(SVA:systemverlog assertion)语法 ---- 转载
摘要:转载自:http://blog.sina.com.cn/s/blog_4c270c730101f6mw.html 作者:白栎旸 断言assertion被放在verilog设计中,方便在仿真时查看异常情况。当异常出现时,断言会报警。一般在数字电路设计中都要加入断言,断言占整个设计的比例应不少于30%。 阅读全文

posted @ 2016-11-23 22:48 hxing 阅读(13226) 评论(0) 推荐(0) 编辑

硬盘的结构与工作原理----转载
摘要:转载自:http://blog.csdn.net/tianxueer/article/details/2689117 一般硬盘正面贴有产品标签,主要包括厂家信息和产品信息,如商标、型号、序列号、生产日期、容量、参数和主从设置方法等。这些信息是正确使用硬盘的基本依据,下面将逐步介绍它们的含义。 硬盘主 阅读全文

posted @ 2016-11-09 00:14 hxing 阅读(833) 评论(0) 推荐(0) 编辑

Xilinx FPGA全局时钟和全局时钟资源的使用方法
摘要:对FPGA的全局时钟了解不多,遂转载一篇文档: http://xilinx.eetop.cn/?action-viewnews-itemid-42 目前,大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计,对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求,一 阅读全文

posted @ 2016-11-01 00:21 hxing 阅读(1342) 评论(0) 推荐(0) 编辑

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