02 2023 档案
摘要：组合逻辑电路 组合逻辑电路分析 初步分析应该是比较简单的，将电路从左看到右边看边写就行，之后再进行化简即可。化简过程中的问题不再赘述。有时候可能会让写真值表、波形图之类的。 波形图按照上图所画照着画就行。ABC组合一共有八种状态，可将其对应到三位的二进制数上。若把ABC当作一个二进制数，就可以很好地
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摘要：锁存器 基本双稳态电路 电路图如下： 若Q=1，则电流在电路中流动后又进一步保证Q=1；反之亦然。故只要该电路进入了一个状态，他就会保持这个状态下去，具有存储的效果（当然，其没有控制机构不能作为真的存储设备）。我们可通过检验Q电平水平得知其所处的状态。 SR锁存器 基本SR锁存器原理 基本SR锁存器
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摘要：触发器 触发器电路结构及工作原理 本节讨论另一 种对脉冲边沿敏感的双稳态电路。如前所述，D锁存器在使能信号上为逻辑期间更新状态。在这期间，它的输出会随输人信号变化。而很多时序电路要求存储电路只对时钟信号的上升沿或下降沿敏 感,而在其他时刻保持状态不变，例如后面将要讨论的移位寄存器和计数器。这种对时钟
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摘要：时序电路 基本概念 基本结构与分类 基本结构 时序电路基本结构如图所示： I为输入信号，O为输出信号，E为驱动存储电路转换为下一状态的激励信号，S为存储电路状态，称为状态信号，亦称状态变量，它表示时序电路当前的状态，简称现态。状态变量S被反馈到组合电路的输人端，与输人信号1一起决定时序电路的输出信号
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摘要：触发器 触发器电路结构及工作原理 本节讨论另一 种对脉冲边沿敏感的双稳态电路。如前所述，D锁存器在使能信号上为逻辑期间更新状态。在这期间，它的输出会随输人信号变化。而很多时序电路要求存储电路只对时钟信号的上升沿或下降沿敏 感,而在其他时刻保持状态不变，例如后面将要讨论的移位寄存器和计数器。这种对时钟
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摘要：逻辑门电路 CMOS逻辑门电路的不同输出结构及参数 CMOS漏极开路门和三态输出门电路 漏极开路门 工程时，我们有时需要将两个门的输出端并联实现与逻辑（此功能成为线与）。但我们不能直接将输出端连在一起，因为这样可能造成电流过大，而且可能两个低电平组合成高电平造成无法区分高低电平。 这一问题我们使用O
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摘要：Machine Learning --007 自助法（Bootstrap）和极大似然法 如何对一堆数据进行建模分析？我们可以通过统计推断。比如我们可以求得其平均值/方差，然后看其接近哪种分布，这就是对数据的一种建模。 统计模型分两种，一种是参数模型，一种是非参数模型。前者，举个例子，我们可以通过设定
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摘要：Machine Learning --006 偏差、方差以及模型复杂度 问题导出：回归方法有很多。可以线性回归，可以多项式回归，可以KNN...但怎样选择、设置模型，才能更好地预测从相同分布中抽样得到的未来数据?我们必须有个有效的判断方法。 模型选择及评估 模型选择: 比较不同模型的表现选择最好的一
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摘要：Machine Learning 005 局部多项式回归 局部多项式回归的拟合 局部多项式回归的拟合，需要我们在每个点
