随笔分类 - Vivado
vivado软件应用
摘要：上篇文章实现了了PS接受来自PL的中断，本片文章将在ZYNQ的纯PS里实现私有定时器中断。每个一秒中断一次，在中断函数里计数加1，通过串口打印输出。 *本文所使用的开发板是Miz702(兼容zedboard) PC 开发环境版本：Vivado 2015.2 Xilinx SDK 2015.2* 中断
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摘要：本篇文章目的是使用Block Memory进行PS和PL的数据交互或者数据共享，通过zynq PS端的Master GP0端口向BRAM写数据，然后再通过PS端的Mater GP1把数据读出来，将结果打印输出到串口终端显示。 涉及到AXI BRAM Controller 和 Block Memery
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摘要：本篇文章主要介绍外设（PL）产生的中断请求，在PS端进行处理。 在PL端通过按键产生中断，PS接受到之后点亮相应的LED. 本文所使用的开发板是zedboardPC 开发环境版本：Vivado 2015.4 Xilinx SDK 2015.4 搭建硬件工程 建好工程后，添加ZYNQ IP 双击 ZY
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摘要：本编文章的目的主要用简明的方法对DDR3进行读写，当然这种方式每次读写都需要CPU干预，效率是比较低的，但是这是学习的过程吧。 本系列文章尽可能的让每一个实验都相对独立，过程尽可能保证完整性，保证实验的可重现性。 但是用到的模块或者IP的具体作用和用法不保证都重复详细的介绍。 本文所使用的开发板是兼
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摘要：关于Tcl在Vivado中的应用文章从Tcl的基本语法和在Vivado中的应用展开，继上篇《用Tcl定制Vivado设计实现流程》介绍了如何扩展甚至是定制FPGA设计实现流程后，引出了一个更细节的应用场景：如何利用Tcl在已完成布局布线的设计上对网表或是布局布线进行局部编辑，从而在最短时间内，以最小
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摘要：很多人用zynq平台做视频图像开发，但是对vdma了解比较少，上手起来稍微有些困难，我针对这一现象，做了一个基于vivado和modelsim的仿真和应用测试工程，并写篇文章做些介绍，希望能对大家有帮助。 一：xilinx vdma IP例化以及接口介绍 上面图片就是在vivado2015.4中例化
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摘要：By Adam Taylor 从上周的博客开始，我们已经进入到Zedboard（而不是MicroZed）板上的OLED显示模块的编程了。然而在正式进入具体的OLED编程之前，我认为有必要验证我们是否已经为应用正确地配置了SPI端口。这个操作可以为我们后续的步骤减少很多时间，并且做起来也很容易。事实上
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摘要：Window→preferences→editor→test editor 对ecilpse的通用方法 打开Eclipse软件，在菜单中选择窗口——首选项，打开新的窗口。 在新的窗口中依次选择常规——编辑器——文本编辑器。 在文本编辑器的窗口中勾选显示行号，然后点击确定按钮。 修改字体颜色
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摘要：vivado软件中也自带仿真工具，但用了几天之后感觉仿真速度有点慢，至少比modelsim慢挺多的。而modelsim是我比较熟悉的一款仿真软件，固然选它作为设计功能的验证。为了将vivado和modelsim关联，需要进行一些设置，下面一一介绍。 一、在vivado中设置modelsim（即第三方
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