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徘徊的游鱼
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2021年4月6日
SV 线程
摘要: 线程的使用 程序和模块 对于硬件的过程块,他们之间的通信可以理解为不同逻辑、时序块之间的通信或者同步,是通过信号的变化来完成; 从硬件实现角度看,verilog 通过always,initial过程语句块和信号数据连接实现进程间通信;可以将不同的module作为独立的程序块,他们之间的同步通过信号的
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posted @ 2021-04-06 19:55 徘徊的游鱼
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