03 2023 档案
摘要：预留寄存器 预留输入输出pin提前穿线，最后只在harden里面修改。避免修改引起其他模块修改。
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摘要：覆盖率检查有的不显示红绿，无法判断有没测试到。 用命令vcs verilog/design.vc -cm cond -cm_cond full verdi tool coverage
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摘要：serdes测试中经常遇到KR4 和KP4， KR4指的是FEC 528 514对应25X4的100G KP4对应FEC 544 514，56/100x4 的200/400G链路 KP4应用比较广泛，纠错能力强，占用的开销稍微大些。最大可以纠错15个symbol,每个symbol 10bit 而KR
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摘要：Linux下^m符号删除 从Windows上复制的代码到Linux尾会有M字符，通过下命令可以删除。 :%s/\r//
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摘要：serdes速率超过50G之后，在VSR光模块场景下SSPRQ使用较为广泛。SSPRQ用于PAM4光模块眼图压力，闭合率测试。 但是有很多serdes IP不支持此功能。出于测试需要需要新设计SSPRQ码型测试。 SSPRQ的定义在802.3协议内部，它来自PRBS31 的4段码型，抽取了最严酷的几
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摘要：replace(string1,start,number,string2) space(8)加空格 vbcrlf换行 trim()去掉两侧空格 lrim()去掉左侧空格 rtrim()去掉右侧空格 left()取字符的左侧 right()取字符串的右侧开始 mid()取字符串的中间位置 int()整
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摘要：类似于assign，用于调试，可以强制给赋值，放在initial后，可以穿透到最内部模块。 force （强制赋值操作）与 release（取消强制赋值）表示第二类过程连续赋值语句。 使用方法和效果，和 assign 与 deassign 类似，但赋值对象可以是 reg 型变量，也可以是 wire
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