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飞机机身控制电子设计，原理图和PCB 阅读全文
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卓越精品科技--精品专业团队硬件团队：bing：资深硬件工程师，6年以上大公司高端项目开发经验，擅长硬件系统设计，FPGA/PCLD设计；驱动开发。lei：资深硬件工程师，6年以上大公司高端项目开发经验，擅长高速PCB设计，硬件系统设计。jun：资深硬件工程师，知名外企5年以上项目开发经验，擅长复杂硬件系统设计。软件团队：song：资深软件工程师，大公司7年以上高端项目开发经验，擅长软件系统设计，架构分析，C/C++开发。feng：资深软件工程师，国内大公司4年以上精品项目开发经验，擅长java软件开发，软件系统设计。ling：资深软件工程师，5年以上外企高端项目开发经验，擅长java软件开发 阅读全文
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无线遥控端主要由Mega128单片机控制，外围电路有无线收发器、液晶显示屏、摇杆、独立按键等。无线收发器：顾名思义，是与飞机端的无线设备进行通信和控制用的，有无线收发模块实现。液晶显示屏：主要显示飞机的飞行状态，和人机交互界面的显示，能够显示飞机和遥控器的电池电量，飞行速度，高度，方位角等等状态信息。摇杆：总共有两个，第一个控制飞机的飞行方向、上升和下降，另外一组控制油门和起落架的方向。按键：主要给飞机发送一些指令，包括打开起落架，返航，进入降落模式，以及其他功能需求。原理图如下：PCB板图如下： 阅读全文
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首先，在Cadence中生成网络表，默认是一个“pstxnet.dat”文件，所有的网络之间的连接关系都在该文件中。 我们也是修改该文件。 现在来操作步骤： 1. 把生成的NetCheckMain.exe和pstxnet.dat文件放在同一个目录，双击运行，会产生out.dat文件。 2. 建立一个Excel表格文件，打开out.dat文件，复制所有内容；粘贴在Excel表格中。 3.... 阅读全文
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从小就有一个梦想，飞向广阔的蓝天。今天启动蓝天计划，DIY一个航模，包括电子设备。主要包括两块核心电路板，无线遥控电路板和机身飞控电路板。无线遥控电路板：主要实现对飞机的控制，包括起飞降落，飞行姿态，飞行方向，监测飞行数据。机身飞控电路板：主要实现接收控制端发来的飞行信号，并实施相应的动作。首先从原理图设计开始！卓越精品电子科技 阅读全文
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名企硬件工程师面试考题大全一、模拟电路1、基尔霍夫定理的内容是什么？（仕兰微电子）2、平板电容公式(C=εS/4πkd)。（未知）3、最基本的如三极管曲线特性。（未知）4、描述反馈电路的概念，列举他们的应用。（仕兰微电子）5、负反馈种类（电压并联反馈，电流串联反馈，电压串联反馈和电流并联反馈）；负反 馈的优点（降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非 线性失真，有效地扩展放大器的通频带，自动调节作用）（未知）6、放大电路的频率补偿的目的是什么，有哪些方法？（仕兰微电子）7、频率响应，如：怎么才算是稳定的，如何改变频响曲线的几个方法。（未知）8、给出一个查分运放，如何 阅读全文
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（*（volatile unsigned long *))这个语句对于不同的计算机体系结构，设备可能是端口映射，也可能是内存映射的。如果系统结构支持独立的IO地址空间，并且是端口映射，就必须使用汇编语言完成实际对设备的控制，因为C语言兵没有提供真正的“端口”的概念。如果是内存映射，那就方便多了。以 #define IOPIN (*((volatile unsigned long *)0xE0028000))为例：作为一个宏定义语句，define是定义一个变量或常量的伪指令。首先 （volatile unsigned long *) 的意思是将后面那个地址强制转换成 volatile unsig 阅读全文
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--File : pc_cpu.vhd library IEEE;use IEEE.STD_LOGIC_1164.all;use IEEE.STD_LOGIC_UNSIGNED.all;use IEEE.STD_LOGIC_ARITH.all; entity gc_cpu is port( SCLK: in std_logic; --50M-- QCLK: in std_logic; --133... 阅读全文
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你在我这所留下来的东西，我无法归还给你。因为在很久以前，你以偷走了我的心。 阅读全文
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以前一直用Q8.1版本，最近换了9.1版本，以为版本搞了Quartus也就先进了，可没想到的是在配置flash的过程中就出问题了。问题：利用Quartus9.1 通过ASP模式配置EPCS串行flash时，重新给FPGA上电，FPGA没有任何反应。通过NIOS II 9.1将Nios 程序烧写到flash中时，重新给FPGA上电，FPGA也没有任何反应。原因：Altera公司在发布Quartus9.1时，该版本中出现了无法配置flash的Bug，也就是通过ASP模式将芯片的配置信息烧写到flash中时，出现某种错误，而JTAG链没有任何提示信息，导致FPGA无法从配置芯片flash中读取配置信 阅读全文