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2016年5月12日
在Cyclone IVE中使用进位链的几个规则
摘要: 最近在FPGA上做ps级的Delay line,所以认真剖析了一下Cyclone IVE4的布局布线延迟。这里说明CARRY链的几个特性规则,如有错误请各位大大指出,谢谢。(另外由于匆忙没有时间验证其他Cyclone系列(基于LE结构)是否遵循此特性,若其他系列中有出入请告知我。。) 规则一:CAR
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posted @ 2016-05-12 19:31 esxgx
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