天嵌通途xczu15eg学习笔记——PS端与PL端DMA的数据交互过程（附加LWIP协议栈）。
摘要：本随笔是参考如下等人的分享并在个人理解上学习LWIP协议栈和xczu15eg的记录。 https://blog.csdn.net/little_soldier/article/details/122851442?spm=1001.2101.3001.6650.8&utm_medium=distrib
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天嵌通途xczu15eg学习笔记——PS端与PL端DMA的数据交互过程。
摘要：该随笔参考了正点原子P15开发板 MPSoC-P15之嵌入式VITIS开发指南V1.0第二十一章 AXI DMA 环路测试的教程。 这里贴出网址http://www.openedv.com/docs/boards/fpga/MPSoC_P15.html。 硬件的配置过程这里不再展示，大家板卡情况不同
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天嵌通途xczu15eg学习笔记——PL端DDR4的MIG IP核配置及测试过程
摘要：首先这是PL端的DDR4芯片，型号为MT40A256M16GE-075E，256Mx16，即512MB，由于不能上传附件，所以PDF还请大家自行上网搜索下载。 DDR4参数的获取参考了以下两个CSDN的博客。 https://ztzhang.blog.csdn.net/article/details
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天嵌通途xczu15eg学习笔记——基于Lwip的TCP服务器性能测试(一)
摘要：学习记录——基于Lwip的TCP服务器性能测试(一) 环境如下，Windows10，vivado2020.2 硬件部分设置如下： PS-PL之间的交互时钟，复位已关闭 Generate Output Products，Create HDL Wrapper，Export Hardware之后进入vit
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