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史昊
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2021年1月26日
Modelsim初使用
摘要: Modelsim初使用 choose-and-click的使用方式这里就不记录了,因为那不是我的使用习惯。接下来介绍如何在Transcript窗口使用modelsim进行基本的仿真。 首先介绍几个普通命令 l file Tcl command: Manipulate file names and a
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posted @ 2021-01-26 16:23 史昊
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2020年10月14日
NRZ(不归零码)转换位Manchester码的verilog实现
摘要: 码字转换器能够将数据流变换成一种已编码的格式,使接受机能够恢复数据。接下来介绍四种常用的串行编码方法。 如果非归零码(NRZ)格式的数据流中,没有1或0的长序列,那么采用锁相环电路PLL就可以从该线数据中恢复出时钟(即将其自身与数据时钟同步);如果非归零反转码(NRZI)或者归零码(RZ)格式的数据
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posted @ 2020-10-14 16:38 史昊
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Verilog实现BCD码到余3码转换器
摘要: 本例把一个串行发送的BCD码转换位一个余3码串行比特流。 将BCD码对应的十进制数加上3,再转化为等效的二进制数就得到了该十进制数的余3码。同时余3码是自补码,即余3码的“9的补数”在硬件上可以通过对码字逐位取反得到。 Mealy型FSM实现是通过每一位数字来了之后是否向下一位进位来实现的。初始状态
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posted @ 2020-10-14 11:32 史昊
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2020年10月12日
Centos部署verilog仿真环境
摘要: 需要安装iverilog和gtkwave,这个两个软件的安装只需要输入这两个命令就可以安装成功,非常方便。 其中iverilog最基本的使用是 1,iverilog -o design -c config.txt 2,vvp design 其中config.txt文件中包含所有需要编译的源文件 gt
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posted @ 2020-10-12 20:12 史昊
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2019年11月17日
报数出局
摘要: 问题:有a个人围成一圈,按序号编号,从第一个人开始报数,数到b时该人退出,并且下一个从1重新开始报数,求出出圈人的顺序。 需要格外注意的情况是当步长b大于剩余人数,t=mod(t,length(x)为0表示数到x的最后一个元素。 编写算法的乐趣便是考虑各种特殊情况,然后将其解决!
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posted @ 2019-11-17 17:11 史昊
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2016年11月14日
Dijkastra算法
摘要: 在C++语言的实现中,Q不是使用的优先队列,而是使用list,便于从中删除元素,但是每次定位元素都需要遍历list,但是因为每次需要删除元素,无法通过索引确定需要的元素,即使使用vector,仍然需要遍历vector,所以使用list更具优势。G使用vector跟随list同步更新,当list为空是
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posted @ 2016-11-14 17:31 史昊
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2016年10月2日
Centos7命令行提示符设置
摘要: 一、Linux登陆过程中家在配置文件顺序:/etc/profile > /etc/profile.d/*.sh > ~/.bash_profile > ~/.bashrc > /etc/bashrc. 二、shell命令提示符及颜色有环境变量PS1设置 这里显示的是我的PS1设置值。 其中颜色设置格
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posted @ 2016-10-02 11:47 史昊
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2016年8月30日
discards qualifier
摘要: const类型限定是细节
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posted @ 2016-08-30 06:42 史昊
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2016年7月17日
算法导论 16.1-1
摘要: 用动态规划方法求解活动选择问题,与贪心算法相比,显然是庞然大物,大材小用了,贪心算法可以非常简洁的求解活动选择问题 动态规划: 代码中添加了a0和a12作为伪活动,辅助问题求解!
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posted @ 2016-07-17 20:32 史昊
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2016年6月5日
空白DirectX11应用程序
摘要: 我用的开发工具是Visual Studio 2015,开发了第一个win32应用程序虽然顺利,但是一旦添加DirectX相关代码应用便无法启动了,出现了一连串问题!让我瞬间一蹶不振!但是隔了几天我尝试的心情又卷土重来,又尝试了一把,终于把应用给启动了! 1,首先第一个问题是“无法启动kernel32
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posted @ 2016-06-05 23:10 史昊
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