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vivado+vscode配置流程

AdriftCoreFpga 2021-01-16 12:25 阅读:6846 评论:0 推荐:0 编辑

STM32与FPGA进行SPI通信

AdriftCoreFpga 2020-01-17 22:45 阅读:4830 评论:0 推荐:0 编辑

vivado警告记录——[Timing 38-316]

AdriftCoreFpga 2021-02-15 21:45 阅读:4051 评论:0 推荐:0 编辑

FPGA——IDELAY应用

AdriftCoreFpga 2022-03-04 00:02 阅读:4047 评论:0 推荐:1 编辑

FPGA——vivado FIFO问题记录

AdriftCoreFpga 2021-02-23 20:02 阅读:3989 评论:0 推荐:1 编辑

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1. Re:FPGA——SPI从机通信实现与仿真
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--可爱的大萌萌
2. Re:FPGA——基于串口校时的数字钟设计
@爱吃花椒的喵酱~ 计数器的加一条件，1，就是一直加一...
--CNL中子
3. Re:FPGA——基于串口校时的数字钟设计
请问add_cnt_div这个信号是干嘛的啊，为什么要这么做呢assign add_cnt_div = 1。不太理解，博主能回答一下吗，感激不尽
--爱吃花椒的喵酱~
4. Re:FPGA——串口通信——使用三状态的状态机实现任意字节的数据发送
@Holme 原工程已经没有了，博客写的就是所有工程文件了...
--CNL中子
5. Re:FPGA——串口通信——使用三状态的状态机实现任意字节的数据发送
@CNL中子您好这个github链接失效了请问一下可以补发工程文件吗我可以付费谢谢您...
--Holme

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