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关于AXI_Quad_SPI的寄存器配置沉默改良者 2018-03-08 09:11 阅读:10388 评论:23 推荐:2

生成用于ROM初始化的coe文件---使用matlab 沉默改良者 2018-10-09 11:31 阅读:5410 评论:4 推荐:1

安装centos7启动项配置沉默改良者 2017-03-06 15:25 阅读:8370 评论:4 推荐:3

BT.656 NTSC制式彩条生成模块(verilog) 沉默改良者 2017-08-09 10:39 阅读:4463 评论:3 推荐:0

KC705开发板关于MIG的配置沉默改良者 2017-07-28 10:00 阅读:1188 评论:3 推荐:0

GTX_SDI搭建流程沉默改良者 2017-05-10 11:49 阅读:1586 评论:3 推荐:1

BeautifulSoup库children(),descendants()方法的使用沉默改良者 2017-04-18 00:33 阅读:5616 评论:3 推荐:0

相位偏转角估计（复数相角计算）---Verilog 沉默改良者 2020-06-29 22:00 阅读:2097 评论:2 推荐:0

数据交织模块---Verilog代码沉默改良者 2020-06-02 22:08 阅读:1778 评论:2 推荐:0

set_false_path的用法沉默改良者 2018-06-06 17:16 阅读:30361 评论:2 推荐:2

解决新版本Vivado打开老工程IP锁住的问题沉默改良者 2017-07-14 16:53 阅读:8954 评论:2 推荐:2

频率偏差角度估计---Verilog 沉默改良者 2020-06-29 21:55 阅读:798 评论:1 推荐:0

关于tpg例程的仿真沉默改良者 2018-06-28 14:58 阅读:1373 评论:1 推荐:0

总线读写---verilog代码沉默改良者 2017-12-20 16:48 阅读:2766 评论:1 推荐:0

关于SD-SDI,HD-SDI,3G-SDI行号的问题沉默改良者 2017-11-30 13:23 阅读:2718 评论:1 推荐:0

GTP+SDI工程播出部分思路整理沉默改良者 2017-07-27 09:11 阅读:2265 评论:1 推荐:1

Verilog HDL那些事_建模篇笔记（实验七：数码管电路驱动）沉默改良者 2016-08-13 18:21 阅读:2416 评论:1 推荐:0

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