摘要：
这几天在调试图像采集和图像压缩的程序，遇到一些问题，暂时记录一下！ 1、图像采集的基本流程是：FPGA通过CameraLink得到相机输出的RAW data，在DDR3在做个缓存，最后通过UDP协议从千兆网口输出至上位机。整个处理流程没有对数据做算法方面的处理，程序结构上比较简单。程序调试过程中遇到 阅读全文
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DDR3调试总结 本文为原创，转载请注明作者与出处 http://blog.csdn.net/hanfei_1/article/details/70546010 以前同是DDR3的无知少年，由于项目需求、工作需要，有幸深入研究DDR3，中间也确实历经各种盲目阶段，查询资料、建立工程、调试错误等等，如 阅读全文
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内存系列二：深入理解硬件原理 老狼 8 个月前 内存系列二：深入理解硬件原理 老狼 8 个月前 8 个月前 本篇文章承接上文继续介绍DDR内存的硬件原理，包括如何寻址，时序和时延以及可以为提高内存的效能可以有哪些方法。 上次虽然解决了小张的问题，却引发了他对内存原理的兴趣。这不他又来找我了，说我还欠 阅读全文
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原文Xilinx官方文档《ug898-vivado-embedded-design》第三章 一、MicroBlaze处理器设计介绍（略） 二、创建带有MicroBlaze处理器的IP设计 使用Vivado进行MicroBlaze设计和使用ISE有很大的不同。（译者加：所以你要仔细看下面的说明） Vi 阅读全文
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本文参考 Xilinx SDK软件内置的教程，打开方法：打开SDK->Help->Cheet Sheets...->Xilinx SDK Tutorials，这里有6篇文档。本文详细介绍其中的4篇（与Application相关） 如何创建一个新的软件应用 1.打开SDK，切换到c/c++界面下。（有 阅读全文
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Vivado_MicroBlaze_问题及解决方法_汇总（不定时更新） Vivado_MicroBlaze_问题及解决方法_汇总（不定时更新） 标签： Vivado 2015-07-03 14:35 4453人阅读 评论(0) 收藏 举报 标签： Vivado 2015-07-03 14:35 44 阅读全文
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1 编译库 用命令行 用vivado工具 vivado 有很多 IP核的接口 已经与 ISE的核 不太一样了，比如fir ，接口就是这样的： fir_lp fir_lp_ip( .aclk (sys_clk ), .aresetn (!module_rst ), .s_axis_data_tvali 阅读全文
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最近在做Zynq的项目，曾经尝试使用ISE+PlanAhead+XPS+SDK组合和Vivado+SDK来搭建工程，使用中发现前者及其不方便后者有诸多不稳定。近期得闻Xilinx退出Vivado2013.4，就迫不及待的想试用一把，看之前的bug是否有修复，稳定性有没有变好，就从和ModelSim的 阅读全文
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vivado软件中也自带仿真工具，但用了几天之后感觉仿真速度有点慢，至少比modelsim慢挺多的。而modelsim是我比较熟悉的一款仿真软件，固然选它作为设计功能的验证。为了将vivado和modelsim关联，需要进行一些设置，下面一一介绍。 一、在vivado中设置modelsim（即第三方 阅读全文
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Scatter-gather DMA 使用一个链表描述物理上不连续的存储空间，然后把链表首地址告诉DMA master。DMA master在传输完一块物理连续的数据后，不用发起中断，而是根据链表来传输下一块物理上连续的数据，直到传输完毕后再发起一次中断。 阅读全文