01 2018 档案
摘要：现在开始对上一篇博文介绍的异步FIFO进行功能验证，上一篇博文地址：http://blog.chinaaet.com/crazybird/p/5100000872 。对异步FIFO验证的平台如图1所示。 图1 异步FIFO验证平台 其中，clock为时钟生成器，asyn_fifo_if为产生异步FI
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摘要：今天要介绍的异步FIFO，可以有不同的读写时钟，即不同的时钟域。由于异步FIFO没有外部地址端口，因此内部采用读写指针并顺序读写，即先写进FIFO的数据先读取（简称先进先出）。这里的读写指针是异步的，处理不同的时钟域，而异步FIFO的空满标志位是根据读写指针的情况得到的。为了得到正确的空满标志位，需
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摘要：基于FPGA的线阵CCD实时图像采集系统 2015年微型机与应用第13期 作者：章金敏，张 菁，陈梦苇2016/2/8 20:52:00 关键词： 实时采集 电荷耦合器件 现场可编程逻辑器件 信号处理 基于FPGA的线阵CCD实时图像采集系统 2015年微型机与应用第13期 作者：章金敏，张 菁，陈
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摘要：quartus可以在Devic and Pin Options里设置默认引脚状态， ISE也有这个功能，步骤如下， 1.右击Generate Programming File 2.选择Process Properties 3.选择Configuration Options 00 4.在右边-g Un
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摘要：Altera FPGA管脚弱上拉电阻的软件设置方法 在使用 Altera 的 FPGA 时候， 由于系统需求， 需要在管脚的内部加上上拉电阻。 Quartus II 软件中在 Assignment Editor 中可以设置。具体过程如下： 1、在菜单 Assignments 中选择 Assignme
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摘要：需求说明：深度学习FPGA实现知识储备 来自：http://blog.csdn.net/stdcoutzyx/article/details/41596663 说明：图文并茂，言简意赅。 自今年七月份以来，一直在实验室负责卷积神经网络（Convolutional Neural Network，CNN
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摘要：转自 飞鸟各投林 史上最强 机器学习经典总结 入门必读 心血总结 回味无穷 让我们从机器学习谈起 导读：在本篇文章中，将对机器学习做个概要的介绍。本文的目的是能让即便完全不了解机器学习的人也能了解机器学习，并且上手相关的实践。当然，本文也面对一般读者，不会对阅读有相关的前提要求。 在进入正题前，我想
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摘要：blink 15年1月 6 Caffe839是一个清晰而高效的深度学习350框架，其作者是博士毕业于UC Berkeley的贾扬清2.2K，目前在Google148工作。 Caffe73是纯粹的C++/CUDA架构，支持命令行、Python和MATLAB接口；可以在CPU和GPU201直接无缝切换：
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摘要：区块链到底是个什么鬼，一幅漫画让你秒懂 字体: 小 中 大 | 打印发布: 2018-1-12 10:58 作者: n 来源: 21世纪经济报道 查看: 930 次 区块链技术是指一种全民参与记账的方式。所有的系统背后都有一个数据库，你可以把数据库看成是就是一个大账本。目前是各自记各自的账。 由于没
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摘要：你也能写个 Shadowsocks 欢迎大家前往云+社区，获取更多腾讯海量技术实践干货哦~ 作者：IMWeb前端团队 本文将教你从0写一个Shadowsocks，无需任何基础，读完本文你就能完成一个轻量级、高性能的 Shadowsocks 代替品。 我们暂且把最终完成的项目叫做 Lightsocks
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摘要：1.AI：人工智能（Artificial Intelligence） 2.机器学习：(Machine Learning, ML) 3.深度学习：Deep Learning 人工功能的实现是让机器自己学习，其中深度学习就是其中一种学习方法，深度学习就是基于多层神经网络发展而来，可以简单看成深度学习就是
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摘要：AI这个概念好像突然就火起来了，年初大比分战胜李世石的AlphaGo成功的吸引了大量的关注，但其实看看你的手机上的语音助手，相机上的人脸识别，今日头条上帮你自动筛选出来的新闻，还有各大音乐软件的歌曲“每日推荐”……形形色色的AI早已进入我们生活的方方面面。深刻的影响了着我们，可以说，这是一个AI的时
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摘要：TensorFlow入门教程之0: BigPicture&极速入门 TensorFlow入门教程之1: 基本概念以及理解 TensorFlow入门教程之2: 安装和使用 TensorFlow入门教程之3: CNN卷积神经网络的基本定义理解 TensorFlow入门教程之4: 实现一个自创的CNN卷积
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摘要：TensorFlow运作方式入门 代码：tensorflow/g3doc/tutorials/mnist/ 本篇教程的目的，是向大家展示如何利用TensorFlow使用（经典）MNIST数据集训练并评估一个用于识别手写数字的简易前馈神经网络（feed-forward neural network）。
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摘要：引言 机器学习栏目记录我在学习Machine Learning过程的一些心得笔记，涵盖线性回归、逻辑回归、Softmax回归、神经网络和SVM等等，主要学习资料来自网上的免费课程和一些经典书籍，免费课程例如Standford Andrew Ng老师在Coursera的教程以及UFLDL Tutori
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摘要：1.Q：ESN device is not available for this cable.INFO:iMPACT - Current time: 2018/1/11 14:38:12// *** BATCH CMD : Program -p 1 -e -v PROGRESS_START - St
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摘要：WINDOWS系统有一个特点,就是新安装的操作系统一般运行速度很快,即使是6年前的,PENTIUM-M级别的电脑,安装WINDOWS-XP启动也之需要四十几秒钟,可以击败60%以上的电脑,如果你每天在使用电脑的过程中,不特别注重维护和保持正确的使用方法, 但很快你会发现你的电脑会越来越慢,有时候，启
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摘要：（1）xp和win7中都可以使用Alt+Tab中进行标签切换，win7中添加了Wins+Tab可以进行3D标签切换。 （2）你知道怎样一次过调整显示器亮度、音量大小，打开无线网，还能够看到本本电池电量吗？把本本的画面放到电视上，已经连好线了，需要怎么设置？小case啦，想要这些功能，你只需要按下Wi
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摘要：C# 遍历枚举 C#中，如何获取(遍历)枚举中所有的值： public enum Suits { Spades, Hearts, Clubs, Diamonds, NumSuits } private static void Main(string[] args) { foreach (Suits
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摘要：基于PCIe的高速接口设计 由 judyzhong 于 星期四, 03/03/2016 - 13:49 发表 作者：李晓宁，姚远程，秦明伟 2016年微型机与应用第1期 摘要：PCIe总线是第三代I/O总线的代表，提供高性能、高速、点到点的串行连接，支持单双工传输，通过差分链路来互连设备。该设计由X
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摘要：xapp1052是xilinx官方给出的一个有关DMA数据传输的样例，用于PC端和FPGA端之间的DMA数据传输。首先需要说的是，xapp1052并不是一个完整的DMA数据传输的终端硬件设计，这在下面会有详细解释。 首先说一下xapp1052模块的组成结构：顶层模块是xilinx_pci_exp_e
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摘要：把Xilinx的IPCORE解密成源代码的方法 1.加密的文件格式以can_v1_5/can_tl_bsp.vhd为例子a)前8个字节XlxV38EB是加密的版本号，没研究过其他加密版本，不知道有什么不同后面的fa00不知道做什么用b)第二行前8字节是这段密文长度，表示过3230H字节后是下一个加密
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摘要：PCIE应用程序编程，首先就要理清PCIE BAR空间到底说的是什么。在PCIE配置空间里，0x10开始后面有6个32位的BAR寄存器，BAR寄存器中存储的数据是表示PCIE设备在PCIE地址空间中的基地址，注意这里不是表示PCIE设备内存在CPU内存中的映射地址，关于这两者的关系以及两者如何转换后
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摘要：开发板：Xilinx K7 KC705 软件：ISE14.7 1.由于应用需求，我们要将开发板作为主机端，通过PCIe接口转接板外接一个NVMe PCIe SSD。并由FPGA控制SSD的数据读写。 因此我们例化生成了一个作为主机端的 PCIe IP核。 类型选择为Root Complex 这里我们
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摘要：dma_test是针对dma硬件设计的仿真测试文件，文件包括DMA写数据测试，DMA读数据测试以及DMA读写数据测试。这个测试文件其实就是模拟pc的应用程序对fpga设备进行DMA读写。 DMA写测试指的是fpga设备往pc端进行DMA方式的写数据，而不是pc端往fpga设备中进行读写，这点要弄清。
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摘要：作者： East FPGA那点事儿 上一章讲述了PCIe总线如何提高DMA的效率。 本章以服务器常用的4通道1000M以太网卡为例讲述如何实现多个虚拟DMA通道。 1.多通道DMA发 4通道以太网卡的数据相互独立，需要4个虚拟DMA发通道实现4路数据独立传输。4个虚拟DMA发通道如下： 多通道DMA
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摘要：作者：East FPGA那点事儿 上一章讲述了PCIe总线DMA的原理和XAPP1052存在的问题。 本章以服务器常用的4通道1000M以太网卡为例讲述如何提高DMA的效率。 1.内存重分配Windows操作系统会划分一部分硬盘空间作为虚拟内存，将长时间不用得应用程序或内存交换到硬盘中，而释放出一部
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摘要：一、 RAM 分类XILINX 的 RAM 可分为三种，分别是：单口 RAM，简化双口 RAM 和真双口 RAM。如下 图所示： 图1 单口 RAM 图2 简化双口 RAM A 口写入数据，B 口读数据 图3 真双口 RAM A,B 任意一个口都可以读写数据，可从 A 写入，B 读数据 二、选择数据
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摘要：由 judyzhong 于 星期五, 09/08/2017 - 14:58 发表 概述 Vivado在设计时可以感觉到一种趋势，它鼓励用IP核的方式进行设计。“IP Integrator”提供了原理图设计的方式，只需要在其中调用设计好的IP核连线。IP核一部分来自于Xilinx官方IP；一部分来自于
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摘要：很多数字传感器、数字控制的芯片（DDS、串行ADC、串行DAC）都是通过IIC总线来和控制器通信的。不过IIC协议仍然是一种慢速的通信方式，标准IIC速率为100kbit/s，快速模式速率为400kbit/s。本文致力于讲述如何用计数器控制和分频时钟控制两种方式完成IIC的读写操作。 IIC协议 I
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摘要：https://wenku.baidu.com/view/24e8bad86f1aff00bed51ef8.html
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摘要：<ignore_js_op> <ignore_js_op> 图 1 – AlexNet 是一种图像识别基准，包含五个卷积层(蓝框)和三个致密层(黄) <ignore_js_op> 图 2 – AlexNet 中的卷积层执行 3D卷积、激活和子采样 <ignore_js_op> 图 3 – 图表展示了
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摘要：基于ZYNQ的FPGA基础入门 基于ZYNQ的Soc入门基础 基于ZYNQ的裸机应用开发 基于ZYNQ硬件的LINUX开发 基于ZYNQ的HLS图像算法设计 基于ZYNQ的图像处理案例 - 何为 Zynq-7000 SoC？ - 为什么需要 Zynq-7000 SoC？ - 如何使用 Zynq-70
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摘要：本文大部分内容来自Clifford E. Cummings的《Simulation and Synthesis Techniques for Asynchronous FIFO Design》，同时加上一些自己的一些理解，有兴趣的朋友可以阅读原文。 一、FIFO简介 FIFO是英文First In
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摘要：javascript递归、循环、迭代、遍历和枚举概念 〓递归(recursion)在数学与计算机科学中，是指在函数的定义中使用函数自身的方法。递归一词还较常用于描述以自相似方法重复事物的过程。例如，当两面镜子相互之间近似平行时，镜中嵌套的图像是以无限递归的形式出现的。 可以理解为：指的是一个函数不断
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摘要：百度网盘： https://wenku.baidu.com/view/21b98975192e45361066f5f3.html 官网下载： http://www.latticesemi.com/Support/SoftwareArchive.aspx
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