modelsin联合仿真
1-选择eda仿真工具 tool-》options-》eda tool options
2-assignments-》settings-》eda tool settings-》simulation-》modelsim
3-编写testbench:
(自动生成操作:processing-》start-》start testbench template writer 一般是要修改的)
4-assignments-》settings-》simulation
compile test bench-》test benches
new-》填写test bench name 和top level module in test bench
添加test bench 仿真文件
5-tool -》run simulation tool-》rtl simulation
如果test beach代码有问题,在modelsim的transcript窗口会提示,各个问题都没有之后,执行5之后,就会跳入modelsim 开始自动仿真。
当有bdf文件时,可以将它转化为v文件,然后将工程的bdf文件替换为v文件,这样仿真的时候modelsim就能找到该模块了.
file--create/update--create HDL designer file from current file
分类:
FPGA
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