2009年6月12日
摘要: 1 Quartus波形仿真的仿真工具Simulation Tool里面,有一个选项是Overwrite simulation input file with simulation result,这一项前面的很容易被误操作勾掉,结果观察不到仿真输出的波形。2 使用VHDL时,两个process里面不能改变相同的信号,这样的信号不能别确定。3 一个process里面只能出现一个时钟,不能引入多余的时钟... 阅读全文
posted @ 2009-06-12 14:14 bluecoffee 阅读(523) 评论(0) 推荐(0) 编辑
摘要: [代码] 阅读全文
posted @ 2009-06-12 13:18 bluecoffee 阅读(2448) 评论(2) 推荐(0) 编辑