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aslmer
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2019年11月7日
FPGA时序约束理解记录
摘要: 最近整理了一下时序约束的内容,顺便发出来分享记录一下。 任何硬件想要工作正常,均需满足建立和保持时间,至于这个概念不再陈述。 下面将重点介绍两个概念:建立余量和保持余量。FPGA内部进行时序分析无非就是计算这两个余量,为正,则时序满足要求,否则不满足。 FPGA在与外部器件打交道时,端口如果为输入则
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posted @ 2019-11-07 23:42 aslmer
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