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2022年10月26日
LBA含义
摘要: 讲LBA前先讲LB:LB是logical Block,是host看到的逻辑块,同时是host读写最小的单位, 这个逻辑块大小由nvme底层物理介质决定。消费级大多为512byte,企业级一般为4k byte。而LBA(logic block address)指的就是前文提到的逻辑块(LB)的地址,h
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posted @ 2022-10-26 15:54 忆亿亿光年
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2019年10月22日
SV中$sformatf(format,args)
摘要: $sformatf,将args传入字符串中,返回字符串结果。
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posted @ 2019-10-22 11:50 忆亿亿光年
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2019年10月17日
关于uvm中的类的注册(待写)
该文被密码保护。
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posted @ 2019-10-17 13:48 忆亿亿光年
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2019年10月16日
Verilog中对事件控制的增强iff
摘要: verilog使用@符号来控制基于特定事件的执行流,SystemVerilog增强了@事件控制。 @标记的一个基本应用——>推断一个具有使能输入的锁存器。下面一个例子演示了一个锁存器建模的基本风格。 这种编码风格效率极其低下,即使在使能输入无效的情况下,数据输入的每次改变都会触发事件控制。 Syst
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posted @ 2019-10-16 16:26 忆亿亿光年
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2019年10月12日
package的意义
摘要: 写的很完善,贴下来 http://blog.eetop.cn/blog-1561828-2316833.html
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posted @ 2019-10-12 17:27 忆亿亿光年
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`ifndef/`define/`endif使用的目的
摘要: 目的:防止某些文件被重复引用,发生增加编译工作量的问题。 `ifndef A_H意思是"if not define A.h"如果不存在A.h 紧接着语句是`define A_H就引入A.h 最后一句是`endif否则不需要引入
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posted @ 2019-10-12 14:41 忆亿亿光年
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2019年9月19日
Systemverilog之随机化
摘要: 6.1介绍 受约束的随即测试法(CRT)解决定向测试覆盖率不足的问题。它能够自己预测测试结果,通过使用计算机处理器的计算能力换取人工检查的时间。 CRT = 随机数据流产生的测试代码(数据) + 伪随机数发生器的种子(行为) ?? 改变种子的值即可改变CRT的行为!! 6.2随机化的优点 挑战性的B
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posted @ 2019-09-19 19:37 忆亿亿光年
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2019年9月5日
问题记录——SystemVerilog
摘要: 1.验证计划怎么会对测试平台结构产生影响呢? 测试平台类似房子,房子有布局结构,由各个模块组成,如厨房、书房、浴室等。测试平台也需要共享一些用于产生激励、检验激励响应的结构。所以验证计划就相当于厨房、书房这种具有某种功能、但还没有建成的房间,只是提供搭建具有某种功能特性房间的建造计划。 2.仿真环境
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posted @ 2019-09-05 10:21 忆亿亿光年
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2019年9月4日
名词解释
摘要: 计分板: 功能覆盖率: 分层协议: 事物类: 断言:debug×× 断言穿过信号层和命令层,负责监测单独信号==>寻找贯穿整个命令的信号变化。 总线事物:从请求总线 到完成总线使用的操作序列 称为总线事物。 它是在一个总线周期内发生的一系列活动。 握手: 线网:线网类型的wire 只是一根连接线,作
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posted @ 2019-09-04 17:36 忆亿亿光年
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2019年9月3日
计划
摘要: 今天计划:把第一章看完。 09/03 09/05完成[捂脸] 要加快进度了 第二章计划:今天把第二章看完。9.6 第三章计划:明天把第三章看完。9.7 只能粗略看了 细看也能看完?
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posted @ 2019-09-03 17:59 忆亿亿光年
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