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2022年7月21日 #

Verilog对数据进行四舍五入(round)与饱和(saturation)截位

摘要: 一、软件平台与硬件平台 软件平台: 操作系统:Windows 8.1 64-bit 开发套件:Vivado2015.4.2 Matlab2016a 仿真工具:Vivado自带仿真器 二、引言 在利用Verilog写数字信号处理相关算法的过程中往往涉及到对数据的量化以及截位处理。而在实际项目中,一种比 阅读全文

posted @ 2022-07-21 17:04 皮皮祥 阅读(546) 评论(0) 推荐(0) 编辑

Verilog 运算符

摘要: 文章目录 一、算术操作符(+ - * / % **) 二、相等操作符(== ! = ! == ==? !=?) 三、逻辑操作符(&& || !) 四、按位操作符(~ & | ^ ^~或 ~^) 五、缩减操作符(& ~& | ~| ^ ~^) 六、移位操作符(<< >> <<< >>>) 七、关系操作 阅读全文

posted @ 2022-07-21 16:55 皮皮祥 阅读(6919) 评论(0) 推荐(1) 编辑

为什么-8对应的原码、补码是1000,反码是1111?

摘要: 4位带符号数X, =1000 的真值是-8 为什么呢?解答如下: 4位带符号数的前提下,-7的补码是1001,-6的补码是1010,-5的补码是1011……0的补码是0000,+1的补码是0001 ,+2的补码是0010……+7的补码是0111 可见 0000~1111这16个补码中只有1000不能 阅读全文

posted @ 2022-07-21 15:12 皮皮祥 阅读(2835) 评论(0) 推荐(0) 编辑

IEEE Std 1364-2001

摘要: Chapter 4.5.2 Rules for expression typesFor non-self-determined operands the following rules apply:if any operand is real, the result is real;if any o 阅读全文

posted @ 2022-07-21 13:39 皮皮祥 阅读(92) 评论(0) 推荐(0) 编辑