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2020年6月11日
【FPGA】VHDL设计模型和程序结构
摘要: VHDL设计模型 数据流模型:直接使用基本门和扩展门描述 行为模型:通过输入输出响应描述 结构化模型:通过低级器件的内联实现 VHDL程序结构 Entity(实体) Architecture(结构体) Configuration(配置) Package(包)、Library(库) Entity(实体
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posted @ 2020-06-11 16:31 Osea
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