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摘要: https://wenku.baidu.com/view/4e627e54f142336c1eb91a37f111f18583d00c20.html https://www.agner.org/optimize/optimizing_assembly.pdf 阅读全文
posted @ 2022-06-14 11:48 zJanly 阅读(8) 评论(0) 推荐(0) 编辑
摘要: The main difference between latency and throughput is that latency refers to the delay to produce the outcome from the input while throughput refers t 阅读全文
posted @ 2022-06-14 11:12 zJanly 阅读(277) 评论(0) 推荐(0) 编辑
摘要: https://api.portal.trustedservices.intel.com/EPID-attestation https://www.intel.com/content/www/us/en/developer/tools/software-guard-extensions/reques 阅读全文
posted @ 2022-06-10 16:55 zJanly 阅读(43) 评论(0) 推荐(0) 编辑
摘要: C52 5*4/2*1(m!)/(n!*(m-n)!)=(m*(m-1)*(m-2)*…*(m-n+2)*(m-n+1))/(n!)= ((m-n+1)/1)*((m-n+2)/2)*((m-n+3)/3)*…*((m-n+n)/n)= ∏((m-n+k)/k)【k=1,2,3,…,n】 func 阅读全文
posted @ 2022-06-10 11:20 zJanly 阅读(277) 评论(0) 推荐(0) 编辑
摘要: https://www.agner.org/optimize/instruction_tables.pdf Integer multiply is at least 3c latency on all recent x86 CPUs (and higher on some older CPUs). 阅读全文
posted @ 2022-06-08 15:43 zJanly 阅读(23) 评论(0) 推荐(0) 编辑
摘要: /*08 1.8 2.913 9.418 1813 1021 160 */ 2013核心i7 4960X,制造工艺为22 nm,晶体管计数为18.6亿。 http://wagnercg.com/Portals/0/FunStuff/AHistoryofMicroprocessorTransistor 阅读全文
posted @ 2022-06-08 14:40 zJanly 阅读(34) 评论(0) 推荐(0) 编辑
摘要: 2、存储器分级策略 既然我们不能用一块存储器来解决所有的需求,那就必须把需求分级。 一种可行的方案,就是根据数据的使用频率使用不同的存储器:高频使用的数据,读写越快越好,因此用最贵的材料,放到离 CPU 最近的位置;使用频率越低的数据,我们放到离 CPU 越远的位置,用越便宜的材料。 2.1 存储器 阅读全文
posted @ 2022-06-08 14:15 zJanly 阅读(273) 评论(0) 推荐(0) 编辑
摘要: https://blog.csdn.net/weixin_39612228/article/details/111344967 .global _ek _ek: lea msg(%rip), %rax //mov msg(%rip), %rax //lea (%rax), %rax ret.data 阅读全文
posted @ 2022-06-07 15:08 zJanly 阅读(55) 评论(0) 推荐(0) 编辑
摘要: sysctl -a | grep machdep.cpu.features lscpu cpuid 阅读全文
posted @ 2022-06-07 11:09 zJanly 阅读(26) 评论(0) 推荐(0) 编辑
摘要: 4.4s* 17.5--mulr 13.1 e 18.62x 4.4 //bmi2s* 17.5 --divr 379 //125e 114 //94ss 48.35sd 57 --vpslld4.4 .global _k_k:movl %edi, %eaxshll $32, %eaxmov %xm 阅读全文
posted @ 2022-06-07 10:40 zJanly 阅读(165) 评论(0) 推荐(0) 编辑
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