04 2021 档案
摘要:@(FPGA设计入门) 实验目的 实验目的: 通过1位全加器的详细设计,掌握原理图输入以及Verilog的两种设计方法。软件基于quartusII 13.0版本,开发板基于Intel DE2-115。 1位全加器可以用两个半加器及一个或门连接而成, 因此需要先完成半加器的设计。 实验步骤 新建工程
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摘要:Python 矩阵基本运算 1. Python 矩阵操作 创建一个2x3的矩阵a.shape:获取矩阵大小a.T:转置矩阵a.transpose:行列转换使用二维数组代替矩阵b=np.array([[1,2,1],[4,5,6]])矩阵、数组加减法写法与普通加减法一样,但是列表不可以这样进行加减法
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