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BUAA-YiFei
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2020年12月4日
使用Verilog搭建一个单周期CPU
摘要: 使用Verilog搭建一个单周期CPU 搭建篇 总体结构 其实跟使用logisim搭建CPU基本一致,甚至更简单,因为完全可以照着logisim的电路图来写,各个模块和模块间的连接在logisim中非常清楚。唯一改变了的只有GRF和DM要多一个input PC端口,用来display的时候输出PC值
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posted @ 2020-12-04 12:08 BUAA-YiFei
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