摘要：1.前言 只要提到AXI总线协议，这就是一个绕不过去的话题，虽然这个话题有点老生常谈，但确实非常重要，其实很多面试官特别喜欢问这个知识点。 2. AXI总线上正常的Burst传输 AXI总线的Transaction是Burst-based的，下图是一个正常的Burst传输示意图。 正常情况下的主机M
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摘要：1. AHB Lite是AHB协议的简化版本。AHB Lite本质上意味着只有一个Master。这反过来也意味着： 1.1.无仲裁； 1.2.无HBUSREQ信号，无HGRANT信号； 1.4.无拆分或重试响应类型->HRESP只能是1位； 1.5.不得提前终止总线。 2. 如何将完整的AHB主设备
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摘要：1.前言 AHB是Advanced High-performance Bus的简称，AHB是 AMBA(Advanced MicrocontrollerBus Architecture高级微控制器总线架构)总线的一部分，AMBA总线最初是ARM公司提出的，如今被市面上大多数SoC芯片所采用。典型的应
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摘要：AHB总线有两个阶段：地址阶段和数据阶段。 HREADY是来自每个Slave的输出信号，它被路由到每个Master和每个Slave。这意味着每个Slave将具有2个HREADY信号：HREADY_in和HREADY_out。即HREADY信号既是Slave的输入和同时又是Slave的输出。 AHB
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摘要：1.前言 相信很多朋友对AMBA都比较熟悉了，对AHB总线也不陌生，在AHB总线中，hready这个信号是最难理解，最容易搞错，也是系统调试的过程中出问题最多的地方之一，同时也是很多面试官最喜欢问的知识点之一。本文做一个梳理，帮助大家彻底理解这个知识点。 2.理解一下hready和hready_ou
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摘要：当某个信号出现多于一个驱动源的时候，或者某个信号是双向(inout)的时候，都需要使用wire来完成线网连接。具体用法就是声明某个信号为wire sigal_a;或者wire logic signal_a;就可以了。 注意直接声明为logic signal_a;是不行的，会报类似如下的错误：xmel
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