随笔分类 - FPGA
摘要：关于Quartus低版本（13.0）打开高版本工程（15.0）时编译出错的问题 最近在家用笔记本打开在学校编写的quartus工程时，遇到一点小问题，由于在学校用的15.0版本，而笔记本装的13.0版本，然后就是编译时出了点问题，找了半天发现没什么这类问题的解答，自己解决后发上来供大家参考 问题描述
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摘要：1."+:"变量[起始地址 +: 数据位宽] <–等价于–> 变量[(起始地址+数据位宽-1)：起始地址] data[0 +: 8] <--等价于--> data[7:0]data[15 +: 2] <--等价于--> data[16:15]2."-:"变量[结束地址 -: 数据位宽] <–等价于–
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摘要：发送“AT”(AT 指令集后要换行)，AT+RST复位一下模块配置 ESP8266 的工作模式为 sta，输入 AT+CWMODE=1AT+CWLAP扫描附近的无线AT+CWJAP="CIMS-GUEST","a1b2c3d4e5f6"AT+CWQAP 来断开 WIFIAT+CIPMUX=0配置连接
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摘要：VGA(Video Graphics Array)，视频图形阵列，是一种视频传输标准，具有分辨率高、显示速度快、颜色丰富等优点，不支持音频传输。 1.VGA简介1.1 VGA接口●VGA接口： VGA是一种D型接口，采用非对称分布连接方式，共有15针，分三排，每排5个孔。 ●VGA接口管脚表： 在1
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摘要：module Baud # ( parameter BPS_PARA = 1250 //12MHz时钟时参数1250对应9600的波特率，12000000/9600 ) ( input clk, //系统时钟 input rst_n, //系统复位，低有效 input bps_en, //接收或发送
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摘要：module Debounce # ( parameter KEY_WIDTH = 1 //消抖按键数量 ) ( input clk, //系统时钟 12MHz input rst_n, //系统复位 低有效 input [KEY_WIDTH-1:0] key_n, //按键信号输入 output
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摘要：module Array_KeyBoard # ( parameter CNT_200HZ = 60000 //5ms ) ( input clk, input rst_n, input [3:0] col, output reg [3:0] row, output reg [15:0] key_o
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摘要：module PWM # ( parameter WIDTH = 32 //ensure that 2**WIDTH > cycle ) ( input clk, input rst_n, input [WIDTH-1:0] cycle, //cycle > duty input [WIDTH-1:
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摘要：module Encoder ( input clk, input rst_n, input key_a, // 旋转编码器EC11的A脚 input key_b, // 旋转编码器EC11的B脚 output reg L_pulse, // 左旋脉冲输出 output reg R_pulse //
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摘要：module DAC081S101_driver ( input clk, input rst_n, output reg dac_done,//DAC采样完成标志 input [7:0] dac_data,//DAC采样数据 output reg dac_sync,//SPI总线CS output
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摘要：module Segment_scan ( input clk, input rst_n, input [3:0] dat_1, //SEG1 显示的数据输入，左边第一个数码管 input [3:0] dat_2, input [3:0] dat_3, input [3:0] dat_4, inpu
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摘要：module Voltage_Meas ( input clk, input rst_n, output adc_cs, output adc_clk, input adc_dat, output [8:0] seg_1, output [8:0] seg_2 ); wire clk_24mhz;
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摘要：参考 一、BCD码概念BCD码（Binary-Coded Decimal），利用四个2进制位储存一个10进制的数，如下表所示。本文所讨论的问题均以8421BCD码为例，十进制的0~9分别用0000~1001来表示。 十进制数23，可表示为0010_0011，十进制数129，可表示为0001_001
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摘要：module ADC081S101_dirver ( input clk, //系统时钟 input rst_n, //系统复位，低有效 output reg adc_cs, //SPI总线CS output reg adc_clk, //SPI总线SCK input adc_dat, //SPI总
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摘要：module Segment_led ( input seg_dot, //seg_dot input input [3:0] seg_data, //seg_dot input output [8:0] segment_led //MSB~LSB = SEG,DP,G,F,E,D,C,B,A );
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摘要：https://zhuanlan.zhihu.com/p/467062385 https://blog.csdn.net/Calvin790704/article/details/124146114
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