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321等风来
2020年6月4日
modelsim 仿真错误
摘要: Q: modelsim 仿真, testbench.v 调用另一个模块的一个task会出现4): Unresolved reference to 'testHarness D,把那些未reference 的文件加载一起仿真。 Verilog里的`符号表bai示宏定义(macro definition
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posted @ 2020-06-04 11:49 321等风来
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