摘要:
若我們從網路上下載範例程式,或者從書上的光碟將範例程式複製到硬碟時,只要是Quartus II版本正確,都可以正常地開啟Quartus II project並且編譯之,但Nios II project卻常常雖然能開啟,卻無法正常編譯,本文討論其root cause並提出解決方式。
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摘要:
DE2-70初學者常常會遇到這個錯誤訊息,在(原創) 如何解決DE2-70的『Error: Can't place pins assigned to pin location Pin_AD25 (IOC_X95_Y2_N1)』的錯誤訊息? (SOC) (Quartus II) (DE2-70)曾經討論過解決方式,不過當時並有解釋為什麼要這樣解(因為我當時也不懂),本文重新徹底討論之。
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摘要:
在上一篇blog,我們學會了將wav檔放在SD卡上,實做出一個SD卡wav player,第一次體會出軟硬體設計的威力。由於FAT16格式的讀取,必須牽涉到軟體的動作,所以必須引入Nios II與Avalon Bus,不能再靠純硬體的方式設計。這次我們將圖片放在SD卡上,在DE2-70實做出一個簡易的數位相框。
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摘要:
在上一篇blog,我們學會如何開發一個硬體Controller,並加上軟體API,讓Nios II軟體能順利地控制硬體,並且讓七段顯示器從0屬到100。或許由同學會問:『要讓七段顯示器從0數到100,我用純硬體的方式開發,全部的Verilog程式碼不超過50行,為什麼要大費周章的使用軟硬體設計的方式呢?還要多學了SOPC Builder、Avalon Bus、Nios II,增加學習曲線,執行速度也比純硬體慢,FPGA所使用的資源(LE)也比純硬體多很多!!』 本Lab是軟硬體設計的精典範例,你將會感受出軟硬體設計的威力。
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摘要:
在上一篇blog,我們已經學會如何將Altera內建的controller加上SOPC Builder,並且用軟體來控制硬體,儘管如此,你會發現在DE2-70上,仍然有很多硬體還沒被驅動,如VGA、LTM、CMOS、Ethernet、Audio CODEC、七段顯示器...等,此外,雖然現在軟體能控制硬體了,卻必須依賴Altera所提供的controller,只要Altera沒提供controller,我們就沒辦法去控制該硬體。在本文中,我們將自己實做出一個Altera沒提供的controller:七段顯示器controller,使七段顯示器能被Nios II軟體所控制,其中包含硬體controller與軟體HAL的開發。
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本文使用Quartus II、SOPC Builder、Nios II EDS從0開始打造一個能在DE2-70上跑μC/OS-II的Nios II系統,初學者可借此範例熟悉Quartus II、SOPC Builder、Nios II EDS的使用,並且了解基於FPGA的嵌入式系統開發流程。
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有一位老兄做了一件不可能的任務:在DE1成功執行DOS 6.22與Windows 3.0,並且開放原始碼供大家研究。
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當我們在μC/OS-II使用Multi Thread時,會將程式包在task內,但要如何將參數傳到task內呢?
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摘要:由 Altera 台灣區唯一授權教育中心 - 友晶科技與大同大學共同主辦的 Altera FPGA 及 SOPC 技術研討會即將於 5/8 盛大舉辦。介紹業界與學界盼望已久,最夯的 Altera DE2 相關技術,課程皆由友晶科技研發高階 FPGA 團隊資深研發經理親自講授。當天除了介紹 Altera 最新研發之高階 FPGA 平台應用外,還會讓學員親自上機實作,教授內容包括在 Altera DE2 上實作 USB 驅動程式,Altera DE2 上的 SD Card 控制原理,另外還首度公開如何在 FPGA 上設計出高階數位電視及音效合成 IC 之核心IP。課程之精采充實,與會人士素質之高,絕對讓您滿載而歸,受益匪淺!
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摘要:大家期待以久的2009年課程總算公佈啦,除了數位影像方面的課程外,還多了數位音效部分,並且贈送Cyclone III Starter Kit這塊版子,我也會去上課,目前談到的價格是三人團報可以打95折,五人團報可以打9折,若有興趣的朋友歡迎跟我聯絡一起團報。
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一直有人反應無法在DE2-70使用SSRAM,主要是top module接法的錯誤,本文提出解決方法。
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只要使用了VGA、TRDB-LCM或者TRDB-LTM,就會使用SDRAM當作frame buffer,由於SDRAM頻寬有限,若沒妥善分配頻寬,最後影像就會不正確。
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摘要:
這是我帶台大電機所『軟硬體共同設計』助教時,兩個電子所學生所做的期末專題,相當精彩,充分發揮了DE2-70的觸控螢幕,SD卡,音效,硬體加速等功能。
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摘要:
DE2-70 CD中的範例,CPU與SDRAM、SRAM都是跑在100MHz,是否能對DE2-70超頻,讓實驗數據更漂亮呢?
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很多人問到如何在TRDB-LTM控制某xy座標輸出的顏色,本文提出解決方法。
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摘要:
在DE2-70,隨便一個Nios II系統在Quartus II編譯後,幾乎都會遇到1個critical warning:『Critical Warning: Timing requirements for slow timing model timing analysis were not met. See Report window for details.』,該如何解決呢?
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摘要:
使用Altera所提供的ip時,如UART、DMA...等,只要在SOPC Builder加進要用的ip,Nios II的C語言include正確的header file後,就可以正常使用,為什麼自己寫的ip,還必須將HAL的*.c複製到project的目錄下才能編譯呢?
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摘要:
在DE2因為只有一顆16 bit的SDRAM,儘管Nios II CPU是32 bit,存取SDRAM時必須透過Dyanamic Bus Sizing機制,花2個clk才能將32 bit資料讀取/寫入SDRAM;但DE2-70有2顆16 bit SDRAM,是否能將這2顆16 bit SDRAM看成1顆32 bit SDRAM使用呢?
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摘要:
開發mater ip時,我們可以自行定義data bus的寬度,也可以透過byteenable定義哪些byte有效,但這兩個方式意義是否相同呢?
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